Revision 23 2-85 Fully Registered I/O Buffers with Synchronous Enable and Asynchronous Clear Figure 2" />
參數(shù)資料
型號： AGL060V5-CS121
廠商： Microsemi SoC
文件頁數(shù)： 4/250頁
文件大?。?/td> 0K
描述： IC FPGA 1KB FLASH 60K 121-CSP
標(biāo)準(zhǔn)包裝： 490
系列： IGLOO
邏輯元件/單元數(shù)： 1536
RAM 位總計： 18432
輸入/輸出數(shù)： 96
門數(shù)： 60000
電源電壓： 1.425 V ~ 1.575 V
安裝類型： 表面貼裝
工作溫度： 0°C ~ 70°C
封裝/外殼： 121-VFBGA，CSBGA
供應(yīng)商設(shè)備封裝： 121-CSP（6x6）
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IGLOO Low Power Flash FPGAs
Revision 23
2-85
Fully Registered I/O Buffers with Synchronous Enable and
Asynchronous Clear
Figure 2-17 Timing Model of the Registered I/O Buffers with Synchronous Enable and Asynchronous Clear
Enable
CLK
Pad
Out
CLK
Enable
CLR
Data_out
Data
Y
AA
EOUT
DOUT
Core
Array
DQ
DFN1E1C1
E
CLR
DQ
DFN1E1C1
E
CLR
DQ
DFN1E1C1
E
CLR
D_Enable
BB
CC
DD
EE
FF
GG
LL
HH
JJ
KK
CLKBUF
INBUF
TRIBUF
INBUF
CLKBUF
INBUF
Data Input I/O Register with
Active High Enable
Active High Clear
Positive-Edge Triggered
Data Output Register and
Enable Output Register with
Active High Enable
Active High Clear
Positive-Edge Triggered
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PDF描述
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