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參數(shù)資料
| 型號： | AFS600-PQG208I |
| 廠商： | Microsemi SoC |
| 文件頁數(shù)： | 278/334頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC FPGA 4MB FLASH 600K 208PQFP |
| 標準包裝： | 24 |
| 系列： | Fusion® |
| RAM 位總計： | 110592 |
| 輸入/輸出數(shù)： | 95 |
| 門數(shù)： | 600000 |
| 電源電壓： | 1.425 V ~ 1.575 V |
| 安裝類型： | 表面貼裝 |
| 工作溫度： | -40°C ~ 100°C |
| 封裝/外殼： | 208-BFQFP |
| 供應(yīng)商設(shè)備封裝： | 208-PQFP（28x28） |
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Device Architecture
2-32
Revision 4
The NGMUX macro is simplified to show the two clock options that have been selected by the
GLMUXCFG[1:0] bits. Figure 2-25 illustrates the NGMUX macro. During design, the two clock sources
are connected to CLK0 and CLK1 and are controlled by GLMUXSEL[1:0] to determine which signal is to
be passed through the MUX.
The sequence of switching between two clock sources (from CLK0 to CLK1) is as follows (Figure 2-26):
GLMUXSEL[1:0] transitions to initiate a switch.
GL drives one last complete CLK0 positive pulse (i.e., one rising edge followed by one falling
edge).
From that point, GL stays Low until the second rising edge of CLK1 occurs.
At the second CLK1 rising edge, GL will begin to continuously deliver the CLK1 signal.
Minimum tsw = 0.05 ns at 25°C (typical conditions)
For examples of NGMUX operation, refer to the Fusion FPGA Fabric User’s Guide.
Figure 2-25 NGMUX Macro
Figure 2-26 NGMUX Waveform
CLK0
CLK1
GL
GLMUXSEL[1:0]
CLK0
CLK1
GLMUXSEL[1:0]
GL
tSW
相關(guān)PDF資料 |
PDF描述 |
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參數(shù)描述 |
|---|---|
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