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參數(shù)資料
| 型號(hào)： | AFS090-2FGG256I |
| 廠商： | Microsemi SoC |
| 文件頁數(shù)： | 271/334頁 |
| 文件大小： | 0K |
| 描述： | IC FPGA 2MB FLASH 90K 256FBGA |
| 標(biāo)準(zhǔn)包裝： | 90 |
| 系列： | Fusion® |
| RAM 位總計(jì)： | 27648 |
| 輸入/輸出數(shù)： | 75 |
| 門數(shù)： | 90000 |
| 電源電壓： | 1.425 V ~ 1.575 V |
| 安裝類型： | 表面貼裝 |
| 工作溫度： | -40°C ~ 100°C |
| 封裝/外殼： | 256-LBGA |
| 供應(yīng)商設(shè)備封裝： | 256-FPBGA（17x17） |
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Fusion Family of Mixed Signal FPGAs
Revision 4
2-25
Global Buffers with No Programmable Delays
The CLKBUF and CLKBUF_LVPECL/LVDS macros are composite macros that include an I/O macro
driving a global buffer, hardwired together (Figure 2-20).
The CLKINT macro provides a global buffer function driven by the FPGA core.
The CLKBUF, CLKBUF_LVPECL/LVDS, and CLKINT macros are pass-through clock sources and do not
use the PLL or provide any programmable delay functionality.
Many specific CLKBUF macros support the wide variety of single-ended and differential I/O standards
supported by Fusion devices. The available CLKBUF macros are described in the IGLOO, ProASIC3,
Figure 2-20 Global Buffers with No Programmable Delay
CLKBUF_LVDS/LVPECL Macro
PADN
PADP
YY
A
PAD
Y
CLKINT Macro
CLKBUF Macro
GLA
or
GLB
or
GLC
Clock Source
Clock Conditioning
Output
None
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| AFS090-2FG256I | IC FPGA 2MB FLASH 90K 256FBGA |
| A42MX09-PQG160A | IC FPGA MX SGL CHIP 14K 160-PQFP |
| A42MX09-PQ160A | IC FPGA MX SGL CHIP 14K 160-PQFP |
| A54SX16P-VQG100 | IC FPGA SX 24K GATES 100-VQFP |
| ABC49DREI-S13 | CONN EDGECARD 98POS .100 EYELET |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| AFS090-2FGG256PP | 制造商:ACTEL 制造商全稱:Actel Corporation 功能描述:Actel Fusion Mixed-Signal FPGAs |
| AFS090-2PQ256ES | 制造商:ACTEL 制造商全稱:Actel Corporation 功能描述:Actel Fusion Mixed-Signal FPGAs |
| AFS090-2PQ256I | 制造商:ACTEL 制造商全稱:Actel Corporation 功能描述:Actel Fusion Mixed-Signal FPGAs |
| AFS090-2PQ256PP | 制造商:ACTEL 制造商全稱:Actel Corporation 功能描述:Actel Fusion Mixed-Signal FPGAs |
| AFS090-2PQG256ES | 制造商:ACTEL 制造商全稱:Actel Corporation 功能描述:Actel Fusion Mixed-Signal FPGAs |
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