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參數(shù)資料
| 型號(hào)： | ADV7150LS135 |
| 廠商： | ANALOG DEVICES INC |
| 元件分類： | 顯示控制器 |
| 英文描述： | CMOS 220 MHz True-Color Graphics Triple 10-Bit Video RAM-DAC |
| 中文描述： | PALETTE-DAC DSPL CTLR, PQFP160 |
| 封裝： | POWER, PLASTIC, QFP-160 |
| 文件頁(yè)數(shù)： | 5/36頁(yè) |
| 文件大?。?/td> | 447K |
| 代理商： | ADV7150LS135 |
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ADV7150
–5–
REV. A
PIXEL INPUT
DATA*
A
N+2
B
N+2
C
N+2
D
N+2
CLOCK
LOADOUT
LOADIN
ANALOG
OUTPUT
DATA
t
10
t
PD
DIGITAL INPUT TO ANALOG
A
N
B
N
C
N
D
N
*INCLUDES PIXEL DATA (R0–R7, G0–G7, B0–B7); PALETTE SELECT INPUTS (PS0–PS1); BLANK; SYNC
A
N+1
B
N+1
C
N+1
D
N+1
A
N
B
N
C
N
D
N
A
N+1
B
N+1
C
N+1
D
N+1
A
N–1
B
N–1
C
N–1
D
N–1
A
N+2
B
N+2
C
N+2
D
N+2
IOR, IOR
IOG, IOG
IOB, IOB
IPLL, SYNCOUT
Figure 4. Pixel Input to Analog Output Pipeline with Minimum LOADOUT to LOADIN Delay (4:1 Multiplex Mode)
OUTPUT
DIGITAL INPUT
A
N+2
B
N+2
C
N+2
D
N+2
CLOCK
LOADOUT
PIXEL INPUT
DATA*
LOADIN
ANALOG
OUTPUT
DATA
A
N
B
N
C
N
D
N
A
N
B
N
C
N
D
N
A
N+1
B
N+1
C
N+1
D
N+1
A
N–1
B
N–1
C
N–1
D
N–1
A
N+2
B
N+2
C
N+2
D
N+2
t
PD
τ
τ
– t
11
*INCLUDES PIXEL DATA (R0–R7, G0–G7, B0–B7); PALETTE SELECT INPUTS (PS0–PS1); BLANK; SYNC
IOR, IOR
IOG, IOG
IOB, IOB
IPLL, SYNCOUT
A
N+1
B
N+1
C
N+1
D
N+1
Figure 5. Pixel Input to Analog Output Pipeline with Maximum LOADOUT to LOADIN Delay (4:1 Multiplex Mode)
相關(guān)PDF資料 |
PDF描述 |
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