參數(shù)資料
型號： ADSP-21365
廠商： Analog Devices, Inc.
元件分類： 數(shù)字信號處理
英文描述： SHARC Processor
中文描述： SHARC處理器
文件頁數(shù)： 21/54頁
文件大?。?/td> 559K
代理商： ADSP-21365
ADSP-21365/6
Preliminary Technical Data
Rev. PrA
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September 2004
Core Timer
The following timing specification applies to FLAG3 when it is
configured as the core timer (CTIMER).
Timer PWM_OUT Cycle Timing
The following timing specification applies to Timer0, Timer1,
and Timer2 in PWM_OUT (pulse width modulation) mode.
Timer signals are routed to the DAI_P20–1 pins through the
SRU. Therefore, the timing specifications provided below are
valid at the DAI_P20–1 pins.
Table 14. Core Timer
Parameter
Switching Characteristic
t
WCTIM
Min
Max
Unit
CTIMER Pulse width
4 × t
PCLK
– 1
ns
Figure 11. Core Timer
FLAG3
(CTIMER)
t
WCTIM
Table 15. Timer PWM_OUT Timing
Parameter
Switching Characteristic
t
PWMO
Min
Max
Unit
Timer Pulse Width Output
2 t
PCLK
– 1
2(2
31
– 1) t
PCLK
ns
Figure 12. Timer PWM_OUT Timing
DAI_P20-1
(TIMER2-0)
t
PWMO
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PDF描述
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