VDD = 2.7 V to 5" />
參數(shù)資料
型號： ADG739BRUZ-REEL
廠商： Analog Devices Inc
文件頁數(shù)： 16/20頁
文件大?。?/td> 0K
描述： IC MUX/DEMUX DUAL 4X1 16TSSOP
產(chǎn)品培訓(xùn)模塊： Switch Fundamentals
標準包裝： 2,500
功能： 多路復(fù)用器/多路分解器
電路： 2 x 4:1
導(dǎo)通狀態(tài)電阻： 4.5 歐姆
電壓電源： 單電源
電壓 - 電源，單路/雙路(±)： 2.7 V ~ 5.5 V
電流 - 電源： 10µA
工作溫度： -40°C ~ 85°C
安裝類型： 表面貼裝
封裝/外殼： 16-TSSOP（0.173"，4.40mm 寬）
供應(yīng)商設(shè)備封裝： 16-TSSOP
包裝： 帶卷 (TR)
Data Sheet
ADG738/ADG739
Rev. A | Page 5 of 20
TIMING CHARACTERISTICS
VDD = 2.7 V to 5.5 V. All specifications 40°C to +105°C, unless otherwise noted.
Table 3.
Parameter1, 2
Limit at T
MIN, TMAX
Unit
Test Conditions/Comments
Min
Max
f
SCLK
30
MHz
SCLK cycle frequency
t
1
33
ns
SCLK cycle time
t
2
13
ns
SCLK high time
t
3
13
ns
SCLK low time
t
4
0
ns
SYNC to SCLK active edge setup time
t
5
ns
Data setup time
t
6
4.5
ns
Data hold time
t
7
0
ns
SCLK falling edge to SYNC rising edge
t
33
ns
Minimum SYNC high time
t
20
ns min
SCLK rising edge to DOUT valid
2 All input signals are specified with tr = tf = 5 ns (10% to 90% of V
DD) and timed from a voltage level of (VIL + VIH)/2.
3 C
L = 20 pF, RL = 1 k.
Figure 3. 3-Wire Serial Interface Timing Diagram
SCLK
SYNC
DIN
DB7
DB0
DB7
1
DB0
1
DOUT
1DATA FROM LAST WRITE CYCLE.
t3
t2
t1
t4
t8
t6
t5
t9
t7
10758-
003
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