AVDD = DV
參數(shù)資料
型號： ADF4360-0BCPZ
廠商： Analog Devices Inc
文件頁數(shù)： 20/24頁
文件大?。?/td> 0K
描述： IC INTEGRATED SYNTH/VCO 24-LFCSP
標(biāo)準(zhǔn)包裝： 1
類型： 扇出配送，整數(shù)-N，合成器（RF）
PLL： 是
輸入： CMOS，TTL
輸出： 時鐘
電路數(shù)： 1
比率 - 輸入:輸出： 1:2
差分 - 輸入:輸出： 無/無
頻率 - 最大： 2.725GHz
除法器/乘法器： 是/無
電源電壓： 3 V ~ 3.6 V
工作溫度： -40°C ~ 85°C
安裝類型： 表面貼裝
封裝/外殼： 24-VFQFN 裸露焊盤，CSP
供應(yīng)商設(shè)備封裝： 24-LFCSP-VQ（4x4）
包裝： 托盤
產(chǎn)品目錄頁面： 551 (CN2011-ZH PDF)
Data Sheet
ADF4360-0
Rev. C | Page 5 of 24
TIMING CHARACTERISTICS1
AVDD = DVDD = VVCO = 3.3 V ± 10%; AGND = DGND = 0 V; 1.8 V and 3 V logic levels used; TA = TMIN to TMAX, unless otherwise noted.
Table 2.
Parameter
Limit at T
MIN to TMAX (B Version)
Unit
Test Conditions/Comments
t
1
20
ns min
LE Setup Time
t
2
10
ns min
DATA to CLOCK Setup Time
t
3
10
ns min
DATA to CLOCK Hold Time
t
4
25
ns min
CLOCK High Duration
t
5
25
ns min
CLOCK Low Duration
t
6
10
ns min
CLOCK to LE Setup Time
t
7
20
ns min
LE Pulse Width
1 See the Power-Up section for the recommended power-up procedure for this device.
CLOCK
DATA
LE
DB23 (MSB)
DB22
DB2
DB1
(CONTROL BIT C2)
DB0 (LSB)
(CONTROL BIT C1)
t1
t2
t3
t7
t6
t4
t5
04644-002
Figure 2. Timing Diagram
相關(guān)PDF資料
PDF描述
ADF4360-4BCPZ IC INT SYNTH/VCO SEALED 24-LFCSP
ADF4360-7BCPZ IC SYNTHESIZER/VCO 24-LFCSP
X9317WM8Z-2.7 IC XDCP SGL 100TAP 10K 8-MSOP
SY89228UMG IC CLK DIVIDER /3/5 LVPECL 16MLF
VE-JVX-MZ-S CONVERTER MOD DC/DC 5.2V 25W
相關(guān)代理商/技術(shù)參數(shù)
參數(shù)描述
ADF4360-0BCPZ 制造商:Analog Devices 功能描述:IC FREQ SYNTHESIZER
ADF4360-0BCPZRL 功能描述:IC SYNTHESIZER VCO 24LFCSP RoHS:是 類別:集成電路 (IC) >> 時鐘/計時 - 時鐘發(fā)生器，PLL，頻率合成器 系列:- 標(biāo)準(zhǔn)包裝:1,000 系列:Precision Edge® 類型:時鐘/頻率合成器 PLL:無 輸入:CML，PECL 輸出:CML 電路數(shù):1 比率 - 輸入:輸出:2:1 差分 - 輸入:輸出:是/是 頻率 - 最大:10.7GHz 除法器/乘法器:無/無 電源電壓:2.375 V ~ 3.6 V 工作溫度:-40°C ~ 85°C 安裝類型:表面貼裝 封裝/外殼:16-VFQFN 裸露焊盤，16-MLF? 供應(yīng)商設(shè)備封裝:16-MLF?（3x3） 包裝:帶卷 (TR) 其它名稱:SY58052UMGTRSY58052UMGTR-ND
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ADF4360-1 制造商:AD 制造商全稱:Analog Devices 功能描述:Integrated Synthesizer and VCO
ADF4360-1_12 制造商:AD 制造商全稱:Analog Devices 功能描述:Integrated Synthesizer and VCO
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