參數(shù)資料
型號(hào)： AD9266BCPZRL7-20
廠商： Analog Devices Inc
文件頁(yè)數(shù)： 24/32頁(yè)
文件大小： 0K
描述： IC ADC 16BIT 20MSPS 32LFCSP
標(biāo)準(zhǔn)包裝： 1,500
位數(shù)： 16
采樣率（每秒）： 20M
數(shù)據(jù)接口： 串行，SPI?
轉(zhuǎn)換器數(shù)目： 1
功率耗散（最大）： 63mW
電壓電源： 模擬和數(shù)字
工作溫度： -40°C ~ 85°C
安裝類型： 表面貼裝
封裝/外殼： 32-WFQFN 裸露焊盤，CSP
供應(yīng)商設(shè)備封裝： 32-LFCSP-WQ（5x5）
包裝： 帶卷 (TR)
輸入數(shù)目和類型： 2 個(gè)單端，單極；1 個(gè)差分，單極
AD9266
Data Sheet
Rev. A | Page 30 of 32
MEMORY MAP REGISTER DESCRIPTIONS
For additional information about functions that are controlled
in Register 0x00 to Register 0xFF, see the AN-877 Application
Note, Interfacing to High Speed ADCs via SPI at www.analog.com.
USR2 (Register 0x101)
Bit 3—Enable GCLK Detect
Normally set high, this bit enables a circuit that detects encode
rates below about 5 MSPS. When a low encode rate is detected,
an internal oscillator, GCLK, is enabled, ensuring the proper
operation of several circuits. If set low, the detector is disabled.
Bit 2—Run GCLK
This bit enables the GCLK oscillator. For some applications
with encode rates below 10 MSPS, it may be preferable to set
this bit high to supersede the GCLK detector.
Bit 0—Disable SDIO Pull-Down
This bit can be set high to disable the internal 30 kΩ pull-down
on the SDIO pin, which can be used to limit the loading when
many devices are connected to the SPI bus.
相關(guān)PDF資料
PDF描述
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參數(shù)描述
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AD9266BCPZRL7-80 功能描述:模數(shù)轉(zhuǎn)換器 - ADC 16 Bit 80 MSPS 1.8V Single ADC RoHS:否 制造商:Analog Devices 通道數(shù)量: 結(jié)構(gòu): 轉(zhuǎn)換速率: 分辨率: 輸入類型: 信噪比: 接口類型: 工作電源電壓: 最大工作溫度: 安裝風(fēng)格: 封裝 / 箱體:
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AD9266TCPZRL7-65EP 制造商:Analog Devices 功能描述:16 BIT, 65 MSPS 1.8V SINGLE ADC EP - Tape and Reel 制造商:Analog Devices 功能描述:IC ADC 16BIT 65MSPS 32LFCSP 制造商:Analog Devices 功能描述:CONVERTER - ADC
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