參數(shù)資料
型號(hào)： AD8153_07
廠商： Analog Devices, Inc.
英文描述： 3.2 Gbps Single Buffered Mux/Demux Switch
中文描述： 3.2 Gbps的單緩沖/解復(fù)用器開關(guān)
文件頁(yè)數(shù)： 4/24頁(yè)
文件大小： 587K
代理商： AD8153_07
AD8153
I
2
C TIMING SPECIFICATIONS
Rev. 0 | Page 4 of 24
SDA
SCL
t
f
t
LOW
t
HD;STA
t
r
t
HD;DAT
t
HIGH
t
SU;DAT
t
f
t
SU;STA
t
HD;STA
t
SP
t
SU;STO
t
r
t
BUF
S
P
Sr
S
0
Figure 2. I
2
C Timing Diagram
Table 2.
Parameter
SCL Clock Frequency
Hold Time for a Start Condition
Set-up Time for a Repeated Start Condition
Low Period of the SCL Clock
High Period of the SCL Clock
Data Hold Time
Data Set-Up Time
Rise Time for Both SDA and SCL
Fall Time for Both SDA and SCL
Set-Up Time for Stop Condition
Bus Free Time Between a Stop Condition and a Start Condition
Capacitance for Each I/O Pin
Symbol
f
SCL
t
HD;STA
t
SU;STA
t
LOW
t
HIGH
t
HD;DAT
t
SU;DAT
t
r
t
f
t
SU;STO
t
BUF
C
i
Min
0
0.6
0.6
1.3
0.6
0
10
1
1
0.6
1
5
Max
400+
–
–
–
–
–
–
300
300
–
–
7
Unit
kHz
μs
μs
μs
μs
μs
ns
ns
ns
μs
ns
pF
相關(guān)PDF資料
PDF描述
AD8153ACPZ 3.2 Gbps Single Buffered Mux/Demux Switch
AD8153ACPZ-RL7 3.2 Gbps Single Buffered Mux/Demux Switch
AD8153-EVALZ 3.2 Gbps Single Buffered Mux/Demux Switch
AD8159 3.2 Gbps Quad Buffer Mux/Demux
AD8159ASVZ 3.2 Gbps Quad Buffer Mux/Demux
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參數(shù)描述
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