參數(shù)資料
型號： AD8106ASTZ
廠商： Analog Devices Inc
文件頁數(shù)： 27/28頁
文件大?。?/td> 0K
描述： IC CROSSPOINT SWITCH 16X5 80LQFP
標準包裝： 1
功能： 視頻交叉點開關(guān)
電路： 1 x 16:5
電壓電源： 雙電源
電壓 - 電源，單路/雙路(±)： ±4.5 V ~ 5.5 V
電流 - 電源： 30mA
工作溫度： -40°C ~ 85°C
安裝類型： 表面貼裝
封裝/外殼： 80-LQFP
供應商設(shè)備封裝： 80-LQFP（12x12）
包裝： 托盤
AD8106/AD8107
Rev. 0 | Page 8 of 28
PIN CONFIGURATION AND FUNCTION DESCRIPTIONS
80
79
78
77
76
75
74
73
72
71
70
69
68
67
66
65
64
63
62
61
56
57
58
59
54
55
52
53
50
51
60
45
46
47
48
43
44
42
49
41
5
4
3
2
7
6
9
8
1
11
10
16
15
14
13
18
17
20
19
12
40
39
38
37
35
34
33
32
31
30
29
28
27
26
25
24
23
22
21
36
DG
ND
DV
CC
IN
07
AG
ND
IN
06
AG
ND
IN
05
AG
ND
IN
04
AG
N
D
IN
03
AG
N
D
IN
02
AG
ND
IN
01
AG
ND
IN
00
DV
C
DG
N
D
RE
S
E
T
AG
N
D
AV
E
NC
AG
N
D
AV
C
NC
AG
N
D
AV
E
04
OU
T0
4
AG
ND
04
A
V
C
C03/
04
OU
T0
3
AG
ND
03
A
V
E
02/
03
OU
T0
2
AG
ND
02
A
V
C
C01/
02
OU
T0
1
AG
ND
01
CE
RESERVED
CLK
RESERVED
UPDATE
RESERVED
A0
A1
A2
D0
D1
D2
D3
D4
AGND
AVEE
AVCC
AVCC00
AGND00
OUT00
IN08
AGND
IN09
AGND
IN10
AGND
IN11
AGND
IN12
AGND
IN13
AGND
IN14
AGND
IN15
AGND
AVEE
AVCC
NC
A
V
E
00/
01
AD8106/AD8107
16 × 5
80L LQFP
(12mm × 12mm)
TOP VIEW
(PINS DOWN)
0.5mm LEAD PITCH
05
77
4-
01
0
PIN 1
INDICATOR
Figure 5. 80-Lead Plastic LQFP
Table 6. Pin Function Descriptions
Pin No.
Mnemonic
Description
INxx
Analog Inputs; xx = Channel Numbers 00 through 15.
64 , 66, 68, 70, 72, 74, 76, 78, 1,
3, 5, 7, 9, 11, 13, 15,
58
CLK
Clock, TTL Compatible. Falling edge triggered.
56
UPDATE
Enable (Transparent) Low. Allows serial register to connect directly to switch matrix. Data
latched when high.
61
RESET
Disable Outputs, Active Low.
60
CE
Chip Enable, Enable Low. Must be low to clock in and latch data.
41, 38, 35, 32, 29
OUTyy
Analog Outputs; yy = Channel Numbers 00 Through 04.
AGND
Analog Ground for Inputs and Switch Matrix.
2, 4, 6, 8, 10, 12, 14, 16, 21, 24, 27,
46, 65, 67, 69, 71, 73, 75, 77
63, 79
DVCC
5 V for Digital Circuitry.
62, 80
DGND
Ground for Digital Circuitry.
17, 22, 45
AVEE
5 V for Inputs and Switch Matrix.
18, 19, 25, 44
AVCC
+5 V for Inputs and Switch Matrix.
42, 39, 36, 33, 30
AGNDxx
Ground for Output Amp; xx = Output Channel Numbers 00 Through 07. Must be connected.
43, 37, 31, 22
AVCCxx/yy
+5 V for Output Amplifier. Shared by channel numbers xx and yy. Must be connected.
40, 34, 28
AVEExx/yy
5 V for Output Amplifier. Shared by channel numbers xx and yy. Must be connected.
54
A0
Parallel Data Input, TTL Compatible (Output Select LSB).
53
A1
Parallel Data Input, TTL Compatible (Output Select).
52
A2
Parallel Data Input, TTL Compatible (Output Select MSB).
51
D0
Parallel Data Input, TTL Compatible (Input Select LSB).
50
D1
Parallel Data Input, TTL Compatible (Input Select).
49
D2
Parallel Data Input, TTL Compatible (Input Select).
48
D3
Parallel Data Input, TTL Compatible (Input Select MSB).
47
D4
Parallel Data Input, TTL Compatible (Output Enable).
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