參數(shù)資料
型號: AD7819YRUZ-REEL7
廠商: Analog Devices Inc
文件頁數(shù): 11/11頁
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描述: IC ADC 8BIT SAMPLING PAR 16TSSOP
標準包裝: 1,000
位數(shù): 8
采樣率(每秒): 200k
數(shù)據(jù)接口: 并聯(lián)
轉換器數(shù)目: 1
功率耗散(最大): 17.5mW
電壓電源: 單電源
工作溫度: -40°C ~ 125°C
安裝類型: 表面貼裝
封裝/外殼: 16-TSSOP(0.173",4.40mm 寬)
供應商設備封裝: 16-TSSOP
包裝: 帶卷 (TR)
輸入數(shù)目和類型: 1 個單端,單極
REV. B
AD7819
–9–
PARALLEL INTERFACE
The parallel interface of the AD7819 is eight bits wide. The out-
put data buffers are activated when both
CS and RD are logic
low. At this point the contents of the data register are placed on
the 8-bit data bus. Figure 15 shows the timing diagram for the par-
allel port. The Parallel Interface of the AD7819 is reset when
BUSY goes logic high. Care must be taken to ensure that a read
operation does not occur while BUSY is high. Data read from
the AD7819 while BUSY is high will be invalid. For optimum
performance the read operation should end at least 100 ns (t8)
prior to the falling edge of the next
CONVST.
8 MSBs
t1
t2
t3
tPOWER-UP
EXT
CONVST
INT
CONVST
BUSY
CS/RD
DB7–DB0
Figure 13. Mode 1 Operation
8 MSBs
t1
t3
EXT
CONVST
INT
CONVST
BUSY
CS/RD
DB7–DB0
tPOWER-UP
Figure 14. Mode 2 Operation
8 MSBs
CONVST
BUSY
CS
DB7–DB0
t2
t3
t1
t4
t6
t7
t5
t8
RD
Figure 15. Parallel Port Timing
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PDF描述
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參數(shù)描述
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