參數資料
| 型號： | AD569JP |
| 廠商： | Analog Devices Inc |
| 文件頁數： | 6/12頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC DAC 16BIT MONO NON-LIN 28PLCC |
| 產品培訓模塊： | Data Converter Fundamentals DAC Architectures |
| 標準包裝： | 1 |
| 設置時間： | 4µs |
| 位數： | 16 |
| 數據接口： | 并聯 |
| 轉換器數目： | 1 |
| 電壓電源： | 雙 ± |
| 工作溫度： | 0°C ~ 70°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 28-LCC（J 形引線） |
| 供應商設備封裝： | 28-PLCC（11.51x11.51） |
| 包裝： | 管件 |
| 輸出數目和類型： | 1 電壓，單極；1 電壓，雙極 |
| 采樣率（每秒）： | * |
AD569
REV. A
–3–
AC PERFORMANCE CHARACTERISTICS
These characteristics are included for Design Guidance Only and are not subject to test.
+VS = +12 V; –VS = –12 V; +VREF = +5 V; –VREF = –5 V excepts where stated.
Parameter
Limit
Units
Test Conditions/Comments
Output Voltage Settling
5
s max
No Load Applied
(Time to
±0.001% FS
3
s typ
(DAC output measured from falling edge of LDAC.)
For FS Step)
6
s max
VOUT Load = 1 k, CLOAD = 1000 pF.
4
s typ
(DAC output measured from falling edge of LDAC. )
Digital-to-Analog Glitch
500
nV-sec typ
Measured with VREF = 0 V. DAC registers alternatively loaded
Impulse
with input codes of 8000H and 0FFFH (worst-case
transition). Load = 1 k
.
Multiplying Feedthrough
–100
dB max
+VREF = 1 V rms 10 kHz sine wave,
–VREF = 0 V
Output Noise Voltage
40
nV/
Hz
typ
Measured between VOUT and –VREF
Density (1 kHz-1 MHz)
TIMING CHARACTERISTICS (+V= +12 V, –VS = –12 V, VIH = 2.4 V, VIL = 0.4 V,TMIN to TMAX)
Parameter
Limit
Units
Test Conditions/Comments
Case A
150 ns Pulse on HBE, LBE, and LDAC
THS = 140 ns min, THH = 10 ns min
tWC
120
ns min
CS
Pulse Width
tSC
60
ns min
CS
Data Setup Time
tHC
20
ns min
CS
Data Hold Time
None
tWB
70
ns min
HBE
, LBE Pulse Width
tSB
80
ns min
HBE
, LBE Data Setup Time
tHB
20
ns min
HBE
, LBE Data Hold Time
tSCS
120
ns min
CS
Setup Time
tHCS
10
ns min
CS
Hold Time
tWD
120
ns min
LDAC
Pulse Width
Case C
None
tWB
120
ns min
HBE
, LBE Pulse Width
tSB
80
ns min
HBE
, LBE Data Setup Time
tHB
20
ns min
HBE
, LBE Data Hold Time
tSCS
120
ns min
CS
Setup Time
tHCS
10
ns min
CS
Hold Time
Figure 2a. AD569 Timing Diagram – Case B
Figure 2b. AD569 Timing Diagram – Case C
Figure 1. AD569 Timing Diagram – Case A
相關PDF資料 |
PDF描述 |
|---|---|
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| VE-B5R-MX-S | CONVERTER MOD DC/DC 7.5V 75W |
| LTC1821-1AIGW#TRPBF | IC D/A CONV 16BIT PRECISE 36SSOP |
| LTC1821AIGW#TR | IC D/A CONV 16BIT PRECISE 36SSOP |
| VE-B5P-MX-S | CONVERTER MOD DC/DC 13.8V 75W |
相關代理商/技術參數 |
參數描述 |
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