TIMING CHARACTERISTICS1, 2, 3 Parameter (B Versions) Units Conditions/Comments
參數資料
型號: AD421BRZRL7
廠商: Analog Devices Inc
文件頁數: 8/14頁
文件大?。?/td> 0K
描述: IC DAC 16BIT LOOP 4-20MA 16SOIC
產品培訓模塊: Data Converter Fundamentals
DAC Architectures
標準包裝: 1
設置時間: 8ms
位數: 16
數據接口: 串行
轉換器數目: 1
電壓電源: 單電源
功率耗散(最大): 450mW
工作溫度: -40°C ~ 85°C
安裝類型: 表面貼裝
封裝/外殼: 16-SOIC(0.295",7.50mm 寬)
供應商設備封裝: 16-SOIC W
包裝: 標準包裝
輸出數目和類型: 1 電流,單極
其它名稱: AD421BRZRL7DKR
AD421
–3–
REV. C
TIMING CHARACTERISTICS1, 2, 3
Parameter
(B Versions)
Units
Conditions/Comments
tCK
100
ns min
Data Clock Period
tCL
50
ns min
Data Clock Low Time
tCH
50
ns min
Data Clock High Time
tDW
30
ns min
Data Stable Width
tDS
30
ns min
Data Setup Time
tDH
0
ns min
Data Hold Time
tLD
50
ns min
Latch Delay Time
tLL
50
ns min
Latch Low Time
tLH
50
ns min
Latch High Time
NOTES
1Guaranteed by characterization at initial product release, not production tested.
2See Figures 1 and 2.
3All input signals are specified with tr = tf = 5 ns (10% to 90% of V
CC ) and timed from a voltage level of (VIN + VIL )/2; tr and tf should not exceed 1
s on any digital
input.
Specifications subject to change without notice.
WORD "N"
WORD "N +1"
10
1
1 1
11
1
00
0
1
0
1
CLOCK
DATA
LATCH
B15
(MSB)
B14
B13
B12
B11
B10
B9
B8
B7
B6
B5
B4
B3
B2
B1
B0
B15
B14
B13
B12
(LSB)
Figure 1. Serial Interface Waveforms (Normal Data Load)
CLOCK
DATA
LATCH
t
CK
t
CL
t
CH
t
DS
t
DH
t
DW
t
LD
t
LL
t
LH
Figure 2. Serial Interface Timing Diagram
(VCC = +3 V to +5 V, TA = TMIN to TMAX unless otherwise noted)
相關PDF資料
PDF描述
AD5326BRUZ IC DAC 12BIT QUAD W/BUFF 16TSSOP
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相關代理商/技術參數
參數描述
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