參數(shù)資料
型號： AD1939YSTZRL
廠商： Analog Devices Inc
文件頁數(shù)： 24/32頁
文件大?。?/td> 0K
描述： IC CODEC 24BIT ADC/DAC 64-LQFP
標(biāo)準(zhǔn)包裝： 1,500
類型： 通用
數(shù)據(jù)接口： 串行
分辨率（位）： 24 b
ADC / DAC 數(shù)量： 4 / 8
三角積分調(diào)變： 是
S/N 比，標(biāo)準(zhǔn) ADC / DAC (db)： 94 / 94
動態(tài)范圍，標(biāo)準(zhǔn) ADC / DAC (db)： 105 / 110
電壓 - 電源，模擬： 3 V ~ 3.6 V
電壓 - 電源，數(shù)字： 3 V ~ 3.6 V
工作溫度： -40°C ~ 105°C
安裝類型： 表面貼裝
封裝/外殼： 64-LQFP
供應(yīng)商設(shè)備封裝： 64-LQFP（10x10）
包裝： 帶卷 (TR)
AD1939
Data Sheet
Rev. E | Page 30 of 32
APPLICATION CIRCUITS
Typical application circuits are shown in Figure 29 through Figure 32. Figure 29 shows a typical ADC input filter circuit. Recommended
loop filters for LR clock and master clock as the PLL reference are shown in Figure 30. Output filters for the DAC outputs are shown in
Figure 31 and a regulator circuit is shown in Figure 32.
2
1
3
OP275
–
+
6
7
5
OP275
–
+
5.76k
237
5.76k
120pF
600Z
AUDIO
INPUT
100pF
5.76k
120pF
4.7F
+
237
4.7F
+
100pF
1nF
NPO
1nF
NPO
ADCxN
ADCxP
06071-
029
Figure 29. Typical ADC Input Filter Circuit
39nF
+
2.2nF
LF
LRCLK
AVDD2
3.32k
5.6nF
390pF
LF
MCLK
AVDD2
562
06071-
030
Figure 30. Recommended Loop Filters for LRCLK or MCLK PLL Reference
06071-
031
2
1
3
OP275
–
+
2.2nF
NPO
AUDIO
OUTPUT
604
68pF
NPO
560pF
NPO
270pF
NPO
DAC
OUTN
3.01k
11k
DAC
OUTP
1.50k
5.62k
11k
5.62k
Figure 31. Typical DAC Output Filter Circuit (Differential)
10F
+
E
C
B
VSUPPLY
5V
VSENSE
3.3V
FZT953
VDRIVE
1k
100nF
10F
+
100nF
06071-
032
Figure 32. Recommended 3.3 V Regulator Circuit
相關(guān)PDF資料
PDF描述
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參數(shù)描述
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AD1940YSTZ1 制造商:AD 制造商全稱:Analog Devices 功能描述:SigmaDSP-TM Multichannel 28-Bit Audio Processor
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