參數(shù)資料
型號(hào)： ABM-PXB4330
英文描述： V1.1 ATM Buffer Manager
中文描述： 緩沖區(qū)管理器1.1版自動(dòng)柜員機(jī)
文件頁數(shù)： 63/201頁
文件大小： 2362K
代理商： ABM-PXB4330
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PXB 4330
Interface Descriptions
Data Sheet
5-63
09.99
5
Interface Descriptions
5.1
UTOPIA Interfaces
The ABM has one UTOPIA Receive Interface and one UTOPIA Transmit Interface with
Master capability at the PHY side and one Receive Interface and one Transmit Interface
with Slave capability at the ATM side (
Figure 5-1
). The interfaces are compliant with the
UTOPIA Level 1 and 2 Specification [1, 2] including:
Bus width is selectable as either 8 bit or 16 bit
Frequency ranges from 19... 52 MHz
Single-PHY or multi-PHY configurations are supported
PHY number enhancement option of UTOPIA Level 2 Appendix 1 is supported.
Figure 5-1
UTOPIA Interfaces
The UTOPIA Receive and transmit Interfaces from the ATM and PHY sides operate from
one clock which may be completely independent from the main chip clock SYSCLK. The
UTOPIA clock frequency must be less than or equal to the main chip clock SYSCLK.
The UTOPIA Interface has both 8-bit and 16-bit options. The 16-bit option features the
54-octet cell format for the standardized format, shown in
Table 5-1
,
or
the proprietary
format, shown in
Table 5-2
. The 8-bit format has 53 octets without the UDF2 octet. The
ATM
Side
TXDATU(15:0)
TXPRTYU
TXCLAVU(3:0)
TXENBU(3:0)
3;%(
$%0
TXSOCU
PHY
Side
TXADRU(3:0)
UTATMCLK
RXDATD(15:0)
RXSOCD
RXPRTYD
RXCLAVD(3:0)
RXENBD(3:0)
RXADRD(3:0)
RXDATU(15:0)
RXSOCU
RXPRTYU
RXCLAVU(3:0)
RXENBU(3:0)
RXADRU(3:0)
UTPHYCLK
TXDATD(15:0)
TXSOCD
TXPRTYD
TXCLAVD(3:0)
TXENBD(3:0)
TXADRD(3:0)
s
s
m
m
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PDF描述
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