參數(shù)資料
型號(hào)： A54SX16A-PQ208B
廠商： Electronic Theatre Controls, Inc.
英文描述： LM136-5.0/LM236-5.0/LM336-5.0 5.0V Reference Diode; Package: TO-46; No of Pins: 3; Qty per Container: 1000; Container: Box
中文描述： 的SX - A系列FPGA的
文件頁(yè)數(shù)： 72/108頁(yè)
文件大小： 720K
代理商： A54SX16A-PQ208B
SX-A Family FPGAs
2-52
v5.1
Table 2-41
A54SX72A Timing Characteristics
(Worst-Case Commercial Conditions V
CCA
= 2.25 V, V
CCI
= 4.75 V, T
J
= 70°C)
Parameter
5 V PCI Output Module Timing
1
Description
–3 Speed
–2 Speed
–1 Speed
Std. Speed
–F Speed
Units
Min. Max. Min. Max. Min. Max. Min. Max. Min. Max.
t
DLH
Data-to-Pad Low to High
2.7
3.1
3.5
4.1
5.7
ns
t
DHL
Data-to-Pad High to Low
3.4
3.9
4.4
5.1
7.2
ns
t
ENZL
Enable-to-Pad, Z to L
1.3
1.5
1.7
2.0
2.8
ns
t
ENZH
Enable-to-Pad, Z to H
2.7
3.1
3.5
4.1
5.7
ns
t
ENLZ
Enable-to-Pad, L to Z
3.0
3.5
3.9
4.6
6.4
ns
t
ENHZ
d
TLH2
d
THL2
5 V TTL Output Module Timing
3
Enable-to-Pad, H to Z
3.4
3.9
4.4
5.1
7.2
ns
Delta Low to High
0.016
0.016
0.02
0.022
0.032
ns/pF
Delta High to Low
0.026
0.03
0.032
0.04
0.052
ns/pF
t
DLH
Data-to-Pad Low to High
2.4
2.8
3.1
3.7
5.1
ns
t
DHL
Data-to-Pad High to Low
3.1
3.5
4.0
4.7
6.6
ns
t
DHLS
Data-to-Pad High to Low—low slew
7.4
8.5
9.7
11.4
15.9
ns
t
ENZL
Enable-to-Pad, Z to L
2.1
2.4
2.7
3.2
4.5
ns
t
ENZLS
Enable-to-Pad, Z to L—low slew
7.4
8.4
9.5
11.0
15.4
ns
t
ENZH
Enable-to-Pad, Z to H
2.4
2.8
3.1
3.7
5.1
ns
t
ENLZ
Enable-to-Pad, L to Z
3.6
4.2
4.7
5.6
7.8
ns
t
ENHZ
d
TLH2
d
THL2
d
THLS2
Enable-to-Pad, H to Z
3.1
3.5
4.0
4.7
6.6
ns
Delta Low to High
0.014
0.017
0.017
0.023
0.031
ns/pF
Delta High to Low
0.023
0.029
0.031
0.037
0.051
ns/pF
Delta High to Low—low slew
0.043
0.046
0.057
0.066
0.089
ns/pF
Notes:
1. Delays based on 50 pF loading.
2. To obtain the slew rate, substitute the appropriate Delta value, load capacitance, and the V
CCI
value into the following equation:
Slew Rate [V/ns] = (0.1*V
CCI
– 0.9*V
CCI)
/ (C
load
* d
T[LH|HL|HLS]
)
where C
load
is the load capacitance driven by the I/O in pF
d
T[LH|HL|HLS]
is the worst case delta value from the datasheet in ns/pF.
3. Delays based on 35 pF loading.
相關(guān)PDF資料
PDF描述
A54SX16A-PQ208I sx-a family FPGAS
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A54SX16A-TQ208A SX-A Family FPGAs
A54SX16A-TQ208B SX-A Family FPGAs
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參數(shù)描述
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A54SX16A-PQG208A 功能描述:IC FPGA SX 24K GATES 208-PQFP RoHS:是 類別:集成電路 (IC) >> 嵌入式 - FPGA（現(xiàn)場(chǎng)可編程門(mén)陣列） 系列:SX-A 標(biāo)準(zhǔn)包裝:90 系列:ProASIC3 LAB/CLB數(shù):- 邏輯元件/單元數(shù):- RAM 位總計(jì):36864 輸入/輸出數(shù):157 門(mén)數(shù):250000 電源電壓:1.425 V ~ 1.575 V 安裝類型:表面貼裝 工作溫度:-40°C ~ 125°C 封裝/外殼:256-LBGA 供應(yīng)商設(shè)備封裝:256-FPBGA（17x17）
A54SX16A-PQG208I 功能描述:IC FPGA SX 24K GATES 208-PQFP RoHS:是 類別:集成電路 (IC) >> 嵌入式 - FPGA（現(xiàn)場(chǎng)可編程門(mén)陣列） 系列:SX-A 標(biāo)準(zhǔn)包裝:90 系列:ProASIC3 LAB/CLB數(shù):- 邏輯元件/單元數(shù):- RAM 位總計(jì):36864 輸入/輸出數(shù):157 門(mén)數(shù):250000 電源電壓:1.425 V ~ 1.575 V 安裝類型:表面貼裝 工作溫度:-40°C ~ 125°C 封裝/外殼:256-LBGA 供應(yīng)商設(shè)備封裝:256-FPBGA（17x17）
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