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參數(shù)資料
| 型號： | A43L0632G-7UF |
| 廠商： | AMIC Technology Corporation |
| 英文描述： | 512K X 32 Bit X 2 Banks Synchronous DRAM |
| 中文描述： | 為512k × 32位× 2銀行同步DRAM |
| 文件頁數(shù)： | 8/44頁 |
| 文件大?。?/td> | 1305K |
| 代理商： | A43L0632G-7UF |
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A43L0632
PRELIMINARY
(August, 2005, Version 0.0)
7
AMIC Technology, Corp.
Operating AC Parameter
(AC operating conditions unless otherwise noted)
Version
Symbol
Parameter
-6
-7
Unit
Note
t
RRD(min)
Row active to row active delay
12
14
ns
1
t
RCD(min)
RAS to
CAS
delay
18
20
ns
1
t
RP(min)
Row precharge time
18
20
ns
1
t
RAS(min)
42
49
ns
1
t
RAS(max)
Row active time
100
100
μ
s
t
RC(min)
Row cycle time
60
68
ns
1
t
CDL(min)
Last data in new col. Address delay
1
CLK
2
t
RDL(min)
Last data in row precharge
2
CLK
2
t
BDL(min)
Last data in to burst stop
1
CLK
2
t
CCD(min)
Col. Address to col. Address delay
1
CLK
Note:
1. The minimum number of clock cycles is determined by dividing the minimum time required with clock cycle time and
then rounding off to the next higher integer.
2. Minimum delay is required to complete write.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| A43L1616 | 1M X 16 Bit X 2 Banks Synchronous DRAM |
| A43L1616V | 1M X 16 Bit X 2 Banks Synchronous DRAM |
| A43L1616V-6F | 1M X 16 Bit X 2 Banks Synchronous DRAM |
| A43L1616V-6UF | 1M X 16 Bit X 2 Banks Synchronous DRAM |
| A43L1616V-7F | 1M X 16 Bit X 2 Banks Synchronous DRAM |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| A43L0632G-95I | 制造商:AMICC 制造商全稱:AMIC Technology 功能描述:1M X 16 Bit X 4 Banks Synchronous DRAM |
| A43L0632V-75I | 制造商:AMICC 制造商全稱:AMIC Technology 功能描述:1M X 16 Bit X 4 Banks Synchronous DRAM |
| A43L0632V-95I | 制造商:AMICC 制造商全稱:AMIC Technology 功能描述:1M X 16 Bit X 4 Banks Synchronous DRAM |
| A43L1616 | 制造商:AMICC 制造商全稱:AMIC Technology 功能描述:1M X 16 Bit X 2 Banks Synchronous DRAM |
| A43L1616G-75I | 制造商:AMICC 制造商全稱:AMIC Technology 功能描述:1M X 16 Bit X 4 Banks Synchronous DRAM |
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