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參數(shù)資料
| 型號(hào)： | A42MX36-FPQG240 |
| 廠商： | Microsemi SoC |
| 文件頁(yè)數(shù)： | 69/142頁(yè) |
| 文件大?。?/td> | 0K |
| 描述： | IC FPGA MX SGL CHIP 54K 240-PQFP |
| 標(biāo)準(zhǔn)包裝： | 24 |
| 系列： | MX |
| RAM 位總計(jì)： | 2560 |
| 輸入/輸出數(shù)： | 202 |
| 門數(shù)： | 54000 |
| 電源電壓： | 3 V ~ 3.6 V，4.75 V ~ 5.25 V |
| 安裝類型： | 表面貼裝 |
| 工作溫度： | 0°C ~ 70°C |
| 封裝/外殼： | 240-BFQFP |
| 供應(yīng)商設(shè)備封裝： | 240-PQFP（32x32） |
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40MX and 42MX FPGA Families
1- 28
R e v i sio n 1 1
Notes:
1. Load-dependent
2. Values are shown for A42MX36 –3 at 5.0 V worst-case commercial conditions.
Figure 1-18 42MX Timing Model (Logic Functions Using Quadrant Clocks)
t
SUD = 3.0 ns
t
HD = 0.0 ns
FMAX=180 MHz
t
CKH=3.03 ns
1
Quadrant
Clocks
t
CO = 1.3 ns
t
RD1 = 0.9 ns
Sequential
Logic Module
t
LH = 0.00 ns
t
LSU = 0.5 ns
t
GHL = 2.9 ns
t
ENHZ = 5.3 ns
t
DLH = 2.6 ns
t
RDD = 0.3 ns
t
PDD = 1.6 ns
t
INH = 0.0 ns
t
INSU = 0.5 ns
t
INGO = 1.4 ns
t
RD1 = 0.9 ns
t
RD2 = 1.3 ns
t
RD4 = 2.0 ns
t
DLH = 2.6 ns
t
PD=1.3 ns
t
INPY = 1.0 ns
t
IRD1= 2.0 ns
I/O Module
Combinatorial
Module
I/O Module
Decode
Module
Comb.
Logic
Include
D
Q
DQ
G
D
Q
I/O Module
Input Delays
Internal Delays
Output Delays
Predicted
Routing
Delays
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PDF描述 |
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