參數(shù)資料
型號： A42MX24-1VQ100M
廠商： Electronic Theatre Controls, Inc.
英文描述： Octal Edge-Triggered D-Type Flip-Flops With 3-State Outputs 20-PDIP -40 to 85
中文描述： 40MX和42MX FPGA系列
文件頁數(shù)： 23/123頁
文件大?。?/td> 854K
代理商： A42MX24-1VQ100M
40MX and 42MX FPGA Families
v6.0
1-17
3.3V LVTTL Electrical Specifications
Table 13
3.3V LVTTL Electrical Specifications
Symbol
Parameter
Commercial
Commercial -F
Industrial
Military
Units
Min.
Max.
Min.
Max.
Min.
Max.
Min.
Max.
V
OH1
V
OL1
I
OH
= –4mA
2.15
2.15
2.4
2.4
V
I
OL
= 6mA
0.4
0.4
0.48
0.48
V
V
IL
–0.3
0.8
–0.3
0.8
–0.3
0.8
–0.3
0.8
V
V
IH
(40MX)
2.0
V
CC
+0.3
2.0
V
CC
+0.3
2.0
V
CC
+0.3
2.0
V
CC
+0.3
V
V
IH
(42MX)
2.0
V
CCI
+0.3
2.0
V
CCI
+0.3
2.0
V
CCI
+0.3
2.0
V
CCI
+0.3
V
I
IL
–10
–10
–10
–10
μA
I
IH
–10
–10
–10
–10
μA
Input Transition Time,
T
R
and T
F
500
500
500
500
ns
C
IO
I/O Capacitance
Standby Current, I
CC2
10
10
10
10
pF
A40MX02,
A40MX04
3
25
10
25
mA
A42MX09
5
25
25
25
mA
A42MX16
6
25
25
25
mA
A42MX24,
A42MX36
15
25
25
25
mA
Low-Power
Standby Current
Mode
42MX
devices only
0.5
I
CC
- 5.0
I
CC
- 5.0
I
CC
- 5.0
mA
I
IO
,
I/O source sink
current
IBIS model
相關PDF資料
PDF描述
A42MX24-2BG100M Octal Edge-Triggered D-Type Flip-Flops With 3-State Outputs 20-SO -40 to 85
A42MX24-2CQ100I Octal Edge-Triggered D-Type Flip-Flops With 3-State Outputs 20-SO -40 to 85
A42MX24-2CQ100M 40MX and 42MX FPGA Families
A42MX24-2PL100 Octal Edge-Triggered D-Type Flip-Flops With 3-State Outputs 20-TSSOP -40 to 85
A42MX24-2PL100A Octal Edge-Triggered D-Type Flip-Flops With 3-State Outputs 20-TSSOP -40 to 85
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參數(shù)描述
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