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參數(shù)資料
| 型號： | A42MX16-FTQ100 |
| 廠商： | Electronic Theatre Controls, Inc. |
| 英文描述： | Octal Transparent D-Type Latches With 3-State Outputs 20-TSSOP -40 to 85 |
| 中文描述： | 40MX和42MX FPGA系列 |
| 文件頁數(shù)： | 35/123頁 |
| 文件大?。?/td> | 854K |
| 代理商： | A42MX16-FTQ100 |
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40MX and 42MX FPGA Families
v6.0
1-29
Note:
Identical timing for falling edge clock.
Figure 1-31
42MX SRAM Synchronous Read Operation
Figure 1-32
42MX SRAM Asynchronous Read Operation—Type 1 (Read Address Controlled)
Figure 1-33
42MX SRAM Asynchronous Read Operation—Type 2 (Write Address Controlled)
RCLK
REN
RDAD[5:0]
RD[7:0]
Old Data
Valid
t
RCKHL
t
CKHL
t
RENH
t
RCO
t
ADH
t
DOH
t
ADSU
New Data
t
RENSU
RDAD[5:0]
RD[7:0]
Data 1
t
RDADV
t
DOH
ADDR2
ADDR1
Data 2
t
RPD
WEN
WD[7:0]
WRAD[5:0]
BLKEN
WCLK
RD[7:0]
Old Data
Valid
t
WENH
t
RPD
t
WENSU
New Data
t
DOH
t
ADSU
t
ADH
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| A42MX16-FTQ100A | Octal Transparent D-Type Latches With 3-State Outputs 20-TSSOP -40 to 85 |
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參數(shù)描述 |
|---|---|
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