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參數(shù)資料
| 型號： | A42MX09-1PL84 |
| 英文描述： | Field Programmable Gate Array (FPGA) |
| 中文描述： | 現(xiàn)場可編程門陣列（FPGA） |
| 文件頁數(shù)： | 16/116頁 |
| 文件大?。?/td> | 3110K |
| 代理商： | A42MX09-1PL84 |
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40MX and 42MX FPGA Families
16
v5.0
Output Drive Characteristics for 3.3V PCI Signaling
DC Specification (3.3V PCI Signaling)
1
PCI
MX
Symbol
Parameter
Condition
Minimum
Maximum
Minimum
Maximum
Units
V
CC
V
IH
V
IL
I
IH
I
IL
V
OH
V
OL
Supply Voltage
3.0
3.6
3.0
3.6
V
Input High Voltage
0.5
V
CC
+ 0.5
0.8
0.5
V
CC
+ 0.3
0.8
V
Input Low Voltage
–
0.5
–
0.3
V
Input High Leakage Current
V
IN
= 2.7
70
10
μA
Input Leakage Current
–
70
–
10
μA
Output High Voltage
I
OUT
=
–
2 mA
I
OUT
= 3 mA,
6 mA
0.9
3.3
V
Output Low Voltage
0.1
0.1 V
CC
V
C
IN
C
CLK
L
PIN
Notes:
1.
2.
3.
Input Pin Capacitance
10
10
pF
CLK Pin Capacitance
5
12
10
pF
Pin Inductance
20
< 8 nH
3
nH
PCI Local Bus Specification Section 4.2.2.1.
Maximum rating for V
CC
–
0.5V to 7.0V.
Dependent upon the chosen package. PCI recommends QFP and BGA packaging to reduce pin inductance and capacitance.
AC Specifications for (3.3V PCI Signaling)
1
PCI
MX
Symbol
Parameter
Condition
Minimum
Maximum
Minimum
Maximum
Units
I
CL
Low Clamp Current
–
5 < V
IN
≤
–
1
–
25 + (V
IN
+1)
/0.015
–
60
–
10
mA
Slew (r)
Output Rise Slew Rate
0.2V to 0.6V load
1
4
1.8
2.8
V/ns
Slew (f)
Output Fall Slew Rate
0.6V to 0.2V load
1
4
2.8
4.0
V/ns
Note:
1.
PCI Local Bus Specification Section 4.2.2.2.
相關PDF資料 |
PDF描述 |
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參數(shù)描述 |
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