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參數(shù)資料
| 型號(hào)： | A42MX09-1BG100ES |
| 廠商： | Electronic Theatre Controls, Inc. |
| 英文描述： | 40MX and 42MX FPGA Families |
| 中文描述： | 40MX和42MX FPGA系列 |
| 文件頁(yè)數(shù)： | 26/123頁(yè) |
| 文件大小： | 854K |
| 代理商： | A42MX09-1BG100ES |
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40MX and 42MX FPGA Families
1-20
v6.0
Output Drive Characteristics for 3.3V PCI Signaling
Table 19
DC Specification (3.3V PCI Signaling)
1
PCI
MX
Symbol
Parameter
Condition
Min.
Max.
Min.
Max.
Units
V
CCI
Supply Voltage for I/Os
3.0
3.6
3.0
3.6
V
V
IH
Input High Voltage
0.5
V
CC
+ 0.5
0.5
V
CCI
+ 0.3
V
V
IL
Input Low Voltage
–0.5
0.8
–0.3
0.8
V
I
IH
Input High Leakage Current
V
IN
= 2.7V
70
10
μA
I
IL
Input Leakage Current
–70
–10
μA
V
OH
Output High Voltage
I
OUT
= –2 mA
0.9
3.3
V
V
OL
Output Low Voltage
I
OUT
= 3 mA,
6 mA
0.1
0.1 V
CCI
V
C
IN
Input Pin Capacitance
10
10
pF
C
CLK
CLK Pin Capacitance
5
12
10
pF
L
PIN
Pin Inductance
20
< 8 nH
3
nH
Notes:
1. PCI Local Bus Specification, Version 2.1, Section 4.2.2.1.
2. Maximum rating for V
CCI
–0.5V to 7.0V.
3. Dependent upon the chosen package. PCI recommends QFP and BGA packaging to reduce pin inductance and capacitance.
Table 20
AC Specifications for (3.3V PCI Signaling)*
PCI
MX
Symbol
Parameter
Condition
–5 < V
IN
≤
–1
Min.
Max.
Min.
Max.
Units
I
CL
Low Clamp Current
–25 + (V
IN
+1)
/0.015
–60
–10
mA
Slew (r)
Output Rise Slew Rate
0.2V to 0.6V load
1
4
1.8
2.8
V/ns
Slew (f)
Output Fall Slew Rate
0.6V to 0.2V load
1
4
2.8
4.0
V/ns
Note:
*PCI Local Bus Specification, Version 2.1, Section 4.2.2.2.
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PDF描述 |
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