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參數(shù)資料
| 型號： | A40MX04-2PQ100I |
| 英文描述： | Field Programmable Gate Array (FPGA) |
| 中文描述： | 現(xiàn)場可編程門陣列（FPGA） |
| 文件頁數(shù)： | 23/116頁 |
| 文件大?。?/td> | 3110K |
| 代理商： | A40MX04-2PQ100I |
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v5.0
23
40MX and 42MX FPGA Families
42MX Timing Model (SRAM Functions)*
*Values are shown for A42MX36
‘–
2
’
at 5.0V worst-case commercial conditions.
t
INH
= 0.00 ns
t
INGO
= 1.55 ns
t
INSU
= 0.53 ns
Input Delays
I/O Module
D
Q
t
INPY
= 1.14 nst
IRD1
= 2.18 ns
Array
Clocks
F
MAX
= 151 MHz
G
t
GHL
= 5.50 ns
t
LSU
= 0.30 ns
LH
= 0.00 ns
I/O Module
t
DLH
= 2.84 ns
D
Q
G
WD [7:0]
WRAD [5:0]
BLKEN
WEN
WCLK
t
ADSU
= 1.80 ns
t
ADH
= 0.00 ns
t
WENSU
= 2.90 ns
t
BENS
= 2.90 ns
RD [7:0]
RDAD [5:0]
REN
RCLK
t
ADSU
= 1.80 ns
t
ADH
= 0.00 ns
t
RENSU
= 0.80 ns
t
RCO
= 3.80 ns
t
RD1
= 1.04 ns
Predicted
Routing
Delays
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| A40MX04-2PQ100M | Field Programmable Gate Array (FPGA) |
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| A40MX04-FPL68 | Field Programmable Gate Array (FPGA) |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
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