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參數(shù)資料
| 型號(hào)： | A40MX04-2PL44 |
| 英文描述： | Field Programmable Gate Array (FPGA) |
| 中文描述： | 現(xiàn)場(chǎng)可編程門陣列（FPGA） |
| 文件頁數(shù)： | 69/116頁 |
| 文件大小： | 3110K |
| 代理商： | A40MX04-2PL44 |
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v5.0
69
40MX and 42MX FPGA Families
A42MX36 Timing Characteristics (Nominal 3.3V Operation)
(continued)
(Worst-Case Commercial Conditions, V
CC
= 3.0V, T
J
= 70
°
C)
Logic Module Timing
‘–
3
’
Speed
‘–
2
’
Speed
‘–
1
’
Speed
‘
Std
’
Speed
‘–
F
’
Speed
Parameter Description
Min.
Max.
Min.
Max.
Min.
Max.
Min.
Max.
Min.
Max.
Units
Synchronous SRAM Operations
t
RC
Read Cycle Time
9.5
10.5
11.9
14.0
19.6
ns
t
WC
Write Cycle Time
9.5
10.5
11.9
14.0
19.6
ns
t
RCKHL
Clock HIGH/LOW Time
4.8
5.3
6.0
7.0
9.8
ns
t
RCO
Data Valid After Clock HIGH/LOW
4.8
5.3
6.0
7.0
9.8
ns
t
ADSU
Address/Data Set-Up Time
2.3
2.5
2.8
3.4
4.8
ns
t
ADH
Address/Data Hold Time
0.0
0.0
0.0
0.0
0.0
ns
t
RENSU
Read Enable Set-Up
0.9
1.0
1.1
1.3
1.8
ns
t
RENH
Read Enable Hold
4.8
5.3
6.0
7.0
9.8
ns
t
WENSU
Write Enable Set-Up
3.8
4.2
4.8
5.6
7.8
ns
t
WENH
Write Enable Hold
0.0
0.0
0.0
0.0
0.0
ns
t
BENS
Block Enable Set-Up
3.9
4.3
4.9
5.7
8.0
ns
t
BENH
Block Enable Hold
0.0
0.0
0.0
0.0
0.0
ns
Asynchronous SRAM Operations
t
RPD
Asynchronous Access Time
11.3
12.6
14.3
16.8
23.5
ns
t
RDADV
Read Address Valid
12.3
13.7
15.5
18.2
25.5
ns
t
ADSU
Address/Data Set-Up Time
2.3
2.5
2.8
3.4
4.8
ns
t
ADH
Address/Data Hold Time
0.0
0.0
0.0
0.0
0.0
ns
t
RENSUA
Read Enable Set-Up to Address Valid
0.9
1.0
1.1
1.3
1.8
ns
t
RENHA
Read Enable Hold
4.8
5.3
6.0
7.0
9.8
ns
t
WENSU
Write Enable Set-Up
3.8
4.2
4.8
5.6
7.8
ns
t
WENH
Write Enable Hold
0.0
0.0
0.0
0.0
0.0
ns
t
DOH
Data Out Hold Time
1.8
2.0
2.1
2.5
3.5
ns
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| A40MX04-2PL44I | Field Programmable Gate Array (FPGA) |
| A40MX04-2PL44M | Field Programmable Gate Array (FPGA) |
| A40MX04-2PL68 | Field Programmable Gate Array (FPGA) |
| A40MX04-2PL68I | Field Programmable Gate Array (FPGA) |
| A40MX04-2PL68M | Field Programmable Gate Array (FPGA) |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| A40MX04-2PL44I | 功能描述:IC FPGA MX SGL CHIP 6K 44-PLCC RoHS:否 類別:集成電路 (IC) >> 嵌入式 - FPGA（現(xiàn)場(chǎng)可編程門陣列） 系列:MX 標(biāo)準(zhǔn)包裝:90 系列:ProASIC3 LAB/CLB數(shù):- 邏輯元件/單元數(shù):- RAM 位總計(jì):36864 輸入/輸出數(shù):157 門數(shù):250000 電源電壓:1.425 V ~ 1.575 V 安裝類型:表面貼裝 工作溫度:-40°C ~ 125°C 封裝/外殼:256-LBGA 供應(yīng)商設(shè)備封裝:256-FPBGA（17x17） |
| A40MX04-2PL44M | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Field Programmable Gate Array (FPGA) |
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| A40MX04-2PL68I | 功能描述:IC FPGA MX SGL CHIP 6K 68-PLCC RoHS:否 類別:集成電路 (IC) >> 嵌入式 - FPGA（現(xiàn)場(chǎng)可編程門陣列） 系列:MX 標(biāo)準(zhǔn)包裝:90 系列:ProASIC3 LAB/CLB數(shù):- 邏輯元件/單元數(shù):- RAM 位總計(jì):36864 輸入/輸出數(shù):157 門數(shù):250000 電源電壓:1.425 V ~ 1.575 V 安裝類型:表面貼裝 工作溫度:-40°C ~ 125°C 封裝/外殼:256-LBGA 供應(yīng)商設(shè)備封裝:256-FPBGA（17x17） |
| A40MX04-2PL68M | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Field Programmable Gate Array (FPGA) |
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