Revision 11 2-25 3.3 V LVCMOS Wide Range Table 2-33 Minimum and Maximum DC Input and Output Levels for 3." />
參數(shù)資料
型號： A3PN030-ZQNG68I
廠商： Microsemi SoC
文件頁數(shù)： 48/114頁
文件大小： 0K
描述： IC FPGA NANO 30K GATES 68-QFN
標(biāo)準(zhǔn)包裝： 260
系列： ProASIC3 nano
輸入/輸出數(shù)： 49
門數(shù)： 30000
電源電壓： 1.425 V ~ 1.575 V
安裝類型： 表面貼裝
工作溫度： -40°C ~ 85°C
封裝/外殼： 68-VFQFN 裸露焊盤
供應(yīng)商設(shè)備封裝： 68-QFN（8x8）
ProASIC3 nano Flash FPGAs
Revision 11
2-25
3.3 V LVCMOS Wide Range
Table 2-33 Minimum and Maximum DC Input and Output Levels for 3.3 V LVCMOS Wide Range
3.3 V LVCMOS
Wide Range
Equivalent
Software
Default
Drive
Strength
Option3
VIL
VIH
VOL
VOH
IOL
IOH
IIL1
IIH2
Drive Strength
Min.
V
Max.
V
Min.
V
Max.
V
Max.
V
Min.
VmA mA
A4
100 A
2 mA
–0.3
0.8
2
3.6
0.2
VDD – 0.2
100 100
10
100 A
4 mA
–0.3
0.8
2
3.6
0.2
VDD – 0.2
100 100
10
100 A
6 mA
–0.3
0.8
2
3.6
0.2
VDD – 0.2
100 100
10
100 A
8mA
–0.3
0.8
2
3.6
0.2
VDD – 0.2
100 100
10
Notes:
1. IIL is the input leakage current per I/O pin over recommended operation conditions where –0.3 V < VIN < VIL.
2. IIH is the input leakage current per I/O pin over recommended operating conditions VIH < VIN < VCCI. Input current is
larger when operating outside recommended ranges.
3. The minimum drive strength for any LVCMOS 3.3 V software configuration when run in wide range is ±100 A. Drive
strength displayed in the software is supported for normal range only. For a detailed I/V curve, refer to the IBIS models.
4. Currents are measured at 85°C junction temperature.
5. All LVMCOS 3.3 V software macros support LVCMOS 3.3 V Wide Range, as specified in the JESD8-B specification.
6. Software default selection highlighted in gray.
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PDF描述
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