參數(shù)資料
型號: A3PN030-Z2VQ100I
元件分類: FPGA
英文描述: FPGA, 768 CLBS, 30000 GATES, PQFP100
封裝: 14 X 14 MM, 1.20 MM HEIGHT, 0.50 MM PITCH, VQFP-100
文件頁數(shù): 32/100頁
文件大?。?/td> 3284K
代理商: A3PN030-Z2VQ100I
ProASIC3 nano DC and Switching Characteristics
Ad vance v0.2
2-23
3.3 V LVCMOS Wide Range
Table 2-33 Minimum and Maximum DC Input and Output Levels for 3.3 V LVCMOS Wide Range
3.3 V LVCMOS
Wide Range
VIL
VIH
VOL
VOH
IOL
IOH
IIL
1
IIH
2
Drive Strength
Min., V
Max., V
Min., V
Max., V
Min., V
mA
A4
Any 3
–0.3
0.8
2
3.6
0.2
VDD – 0.2
100
10
Notes:
1. IIL is the input leakage current per I/O pin over recommended operation conditions where –0.3 V < VIN <
VIL.
2. IIH is the input leakage current per I/O pin over recommended operating conditions VIH < VIN < VCCI. Input
current is larger when operating outside recommended ranges.
3. All LVMCOS 3.3 V software macros support LVCMOS 3.3 V Wide Range, as specified in the JESD8-B
specification.
4. Currents are measured at 85°C junction temperature.
相關PDF資料
PDF描述
A3PN030-Z2VQ100 FPGA, 768 CLBS, 30000 GATES, PQFP100
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相關代理商/技術參數(shù)
參數(shù)描述
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