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參數資料
| 型號： | A3P1000-1FGG144FG144 |
| 元件分類： | FPGA |
| 英文描述： | FPGA, 1000000 GATES, PBGA144 |
| 封裝： | 1 MM PITCH, GREEN, FBGA-144 |
| 文件頁數： | 472/608頁 |
| 文件大小： | 20486K |
| 代理商： | A3P1000-1FGG144FG144 |
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Security in Low-Power Flash Devices
v1.1
15- 5
CoreMP7 Device Security
ARM7 (M7-enabled) devices are shipped with the following security features:
FPGA array enabled for AES-encrypted programming and verification
FlashROM enabled for plaintext Read and Write
Cortex-M1 Device Security
Cortex-M1–enabled devices are shipped with the following security features:
FPGA array enabled for AES-encrypted programming and verification
FlashROM enabled for AES-encrypted Write and Verify
Fusion Embedded Flash Memory enabled for AES-encrypted Write
AES Encryption of Programming Files
Low-power flash devices employ AES as part of the security mechanism that prevents invasive and
noninvasive attacks. The mechanism entails encrypting the programming file with AES encryption
and then passing the programming file through the AES decryption core, which is embedded in the
device. The file is decrypted there, and the device is successfully programmed. The AES master key
is stored in on-chip nonvolatile memory (flash). The AES master key can be preloaded into parts in
a secure programming environment (such as the Actel In-House Programming center), and then
"blank" parts can be shipped to an untrusted programming or manufacturing center for final
personalization with an AES-encrypted bitstream. Late-stage product changes or personalization
can be implemented easily and securely by simply sending a STAPL file with AES-encrypted data.
Secure remote field updates over public networks (such as the Internet) are possible by sending and
programming a STAPL file with AES-encrypted data.
The AES key protects the programming data for file transfer into the device, with 128-bit AES
encryption. If AES encryption is used, the AES key is stored or preprogrammed into the device. To
program, you must use an AES-encrypted file, and the encryption used on the file must match the
encryption key already in the device.
The AES key is protected by a FlashLock security Pass Key that is also implemented in each device.
The AES key is always protected by the FlashLock Key, and the AES-encrypted file does NOT contain
the FlashLock Key. This FlashLock Pass Key technology is exclusive to the Actel flash-based device
families. FlashLock Pass Key technology can also be implemented without the AES encryption
option, providing a choice of different security levels.
In essence, security features can be categorized into the following three options:
AES encryption with FlashLock Pass Key protection
FlashLock protection only (no AES encryption)
No protection
Each of the above options is explained in more detail in the following sections with application
examples and software implementation options.
Advanced Encryption Standard
The 128-bit AES standard (FIPS-192) block cipher is the NIST (National Institute of Standards and
Technology) replacement for DES (Data Encryption Standard FIPS46-2). AES has been designed to
protect sensitive government information well into the 21st century. It replaces the aging DES,
which NIST adopted in 1977 as a Federal Information Processing Standard used by federal agencies
to protect sensitive, unclassified information. The 128-bit AES standard has 3.4 × 1038 possible
128-bit key variants, and it has been estimated that it would take 1,000 trillion years to crack
128-bit AES cipher text using exhaustive techniques. Keys are stored (securely) in low-power flash
devices in nonvolatile flash memory. All programming files sent to the device can be authenticated
by the part prior to programming to ensure that bad programming data is not loaded into the part
that may possibly damage it. All programming verification is performed on-chip, ensuring that the
contents of low-power flash devices remain secure.
Actel has implemented the 128-bit AES (Rijndael) algorithm in low-power flash devices. With this
key size, there are approximately 3.4 × 1038 possible 128-bit keys. DES has a 56-bit key size, which
provides approximately 7.2 × 1016 possible keys. In their AES fact sheet, the National Institute of
相關PDF資料 |
PDF描述 |
|---|---|
| A3P1000-1FGG144IFG144 | FPGA, 1000000 GATES, PBGA144 |
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| A3P1000-1FGG484IFG484 | FPGA, 1000000 GATES, PBGA484 |
相關代理商/技術參數 |
參數描述 |
|---|---|
| A3P1000-1FGG144I | 功能描述:IC FPGA 1KB FLASH 1M 144-FBGA RoHS:是 類別:集成電路 (IC) >> 嵌入式 - FPGA（現場可編程門陣列） 系列:ProASIC3 標準包裝:40 系列:SX-A LAB/CLB數:6036 邏輯元件/單元數:- RAM 位總計:- 輸入/輸出數:360 門數:108000 電源電壓:2.25 V ~ 5.25 V 安裝類型:表面貼裝 工作溫度:0°C ~ 70°C 封裝/外殼:484-BGA 供應商設備封裝:484-FPBGA（27X27） |
| A3P1000-1FGG144M | 制造商:Microsemi Corporation 功能描述:FPGA ProASIC?3 Family 1M Gates 130nm Technology 1.5V 144-Pin FBGA 制造商:Microsemi Corporation 功能描述:FPGA PROASIC3 FAMILY 1M GATES 130NM (CMOS) TECHNOLOGY 1.5V 1 - Trays 制造商:Microsemi Corporation 功能描述:IC FPGA 97 I/O 144FBGA |
| A3P1000-1FGG144PP | 制造商:ACTEL 制造商全稱:Actel Corporation 功能描述:ProASIC3 Flash Family FPGAs |
| A3P1000-1FGG144T | 功能描述:IC FPGA 1KB FLASH 1M 144-FBGA RoHS:是 類別:集成電路 (IC) >> 嵌入式 - FPGA（現場可編程門陣列） 系列:ProASIC3 產品培訓模塊:Three Reasons to Use FPGA's in Industrial Designs Cyclone IV FPGA Family Overview 特色產品:Cyclone? IV FPGAs 標準包裝:60 系列:CYCLONE® IV GX LAB/CLB數:9360 邏輯元件/單元數:149760 RAM 位總計:6635520 輸入/輸出數:270 門數:- 電源電壓:1.16 V ~ 1.24 V 安裝類型:表面貼裝 工作溫度:0°C ~ 85°C 封裝/外殼:484-BGA 供應商設備封裝:484-FBGA（23x23） |
| A3P1000-1FGG256 | 功能描述:IC FPGA 1KB FLASH 1M 256-FBGA RoHS:是 類別:集成電路 (IC) >> 嵌入式 - FPGA（現場可編程門陣列） 系列:ProASIC3 標準包裝:90 系列:ProASIC3 LAB/CLB數:- 邏輯元件/單元數:- RAM 位總計:36864 輸入/輸出數:157 門數:250000 電源電壓:1.425 V ~ 1.575 V 安裝類型:表面貼裝 工作溫度:-40°C ~ 125°C 封裝/外殼:256-LBGA 供應商設備封裝:256-FPBGA（17x17） |
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