Revision 13 2-17 Figure 2-5 Tristate Output Buffer Timing Model and Delays (example) D CLK Q D CLK Q
參數(shù)資料
型號(hào)： A3P060-1VQG100
廠商： Microsemi SoC
文件頁(yè)數(shù)： 146/220頁(yè)
文件大小： 0K
描述： IC FPGA 1KB FLASH 60K 100-VQFP
標(biāo)準(zhǔn)包裝： 90
系列： ProASIC3
RAM 位總計(jì)： 18432
輸入/輸出數(shù)： 71
門(mén)數(shù)： 60000
電源電壓： 1.425 V ~ 1.575 V
安裝類(lèi)型： 表面貼裝
工作溫度： 0°C ~ 70°C
封裝/外殼： 100-TQFP
供應(yīng)商設(shè)備封裝： 100-VQFP（14x14）
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ProASIC3 Flash Family FPGAs
Revision 13
2-17
Figure 2-5 Tristate Output Buffer Timing Model and Delays (example)
D
CLK
Q
D
CLK
Q
10% VCCI
tZL
Vtrip
50%
tHZ
90% VCCI
tZH
Vtrip
50%
tLZ
50%
EOUT
PAD
D
E
50%
tEOUT (R)
50%
tEOUT (F)
PAD
DOUT
EOUT
D
I/O Interface
E
tEOUT
tZLS
Vtrip
50%
tZHS
Vtrip
50%
EOUT
PAD
D
E
50%
tEOUT (R)
tEOUT (F)
50%
VCC
VCCI
VCC
VOH
VOL
tZL, tZH, tHZ, tLZ, tZLS, tZHS
tEOUT = MAX(tEOUT(r), tEOUT(f))
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PDF描述
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