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參數(shù)資料
| 型號(hào)： | A1020B-PL68I |
| 廠商： | Microsemi SoC |
| 文件頁(yè)數(shù)： | 16/98頁(yè) |
| 文件大?。?/td> | 0K |
| 描述： | IC FPGA 2K GATES 68-PLCC IND |
| 標(biāo)準(zhǔn)包裝： | 19 |
| 系列： | ACT™ 1 |
| LAB/CLB數(shù)： | 547 |
| 輸入/輸出數(shù)： | 57 |
| 門(mén)數(shù)： | 2000 |
| 電源電壓： | 4.5 V ~ 5.5 V |
| 安裝類(lèi)型： | 表面貼裝 |
| 工作溫度： | -40°C ~ 85°C |
| 封裝/外殼： | 68-LCC（J 形引線(xiàn)） |
| 供應(yīng)商設(shè)備封裝： | 68-PLCC（24.23x24.23） |
第1頁(yè)第2頁(yè)第3頁(yè)第4頁(yè)第5頁(yè)第6頁(yè)第7頁(yè)第8頁(yè)第9頁(yè)第10頁(yè)第11頁(yè)第12頁(yè)第13頁(yè)第14頁(yè)第15頁(yè)當(dāng)前第16頁(yè)第17頁(yè)第18頁(yè)第19頁(yè)第20頁(yè)第21頁(yè)第22頁(yè)第23頁(yè)第24頁(yè)第25頁(yè)第26頁(yè)第27頁(yè)第28頁(yè)第29頁(yè)第30頁(yè)第31頁(yè)第32頁(yè)第33頁(yè)第34頁(yè)第35頁(yè)第36頁(yè)第37頁(yè)第38頁(yè)第39頁(yè)第40頁(yè)第41頁(yè)第42頁(yè)第43頁(yè)第44頁(yè)第45頁(yè)第46頁(yè)第47頁(yè)第48頁(yè)第49頁(yè)第50頁(yè)第51頁(yè)第52頁(yè)第53頁(yè)第54頁(yè)第55頁(yè)第56頁(yè)第57頁(yè)第58頁(yè)第59頁(yè)第60頁(yè)第61頁(yè)第62頁(yè)第63頁(yè)第64頁(yè)第65頁(yè)第66頁(yè)第67頁(yè)第68頁(yè)第69頁(yè)第70頁(yè)第71頁(yè)第72頁(yè)第73頁(yè)第74頁(yè)第75頁(yè)第76頁(yè)第77頁(yè)第78頁(yè)第79頁(yè)第80頁(yè)第81頁(yè)第82頁(yè)第83頁(yè)第84頁(yè)第85頁(yè)第86頁(yè)第87頁(yè)第88頁(yè)第89頁(yè)第90頁(yè)第91頁(yè)第92頁(yè)第93頁(yè)第94頁(yè)第95頁(yè)第96頁(yè)第97頁(yè)第98頁(yè)
23
Hi R e l F P GA s
Du al - P or t S RAM T i mi ng Wa ve f o r m s
3200 DX S R A M W ri te Ope rat i o n
Note:
Identical timing for falling-edge clock.
3200 DX S R A M S y nch ro nous R ead Oper at i o n
Note:
Identical timing for falling-edge clock.
WCLK
WD[7:0]
WRAD[5:0]
WEN
BLKEN
Valid
tRCKHL
tWENSU
tBENSU
tWENH
tBENH
tADSU
tADH
RCLK
REN
RDAD[5:0]
RD[7:0]
Old Data
Valid
tRCKHL
tCKHL
tRENH
tRCO
tADH
tDOH
tADSU
New Data
tRENSU
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