參數(shù)資料
型號： 9DB833AFILFT
廠商： INTEGRATED DEVICE TECHNOLOGY INC
元件分類： 時鐘及定時
英文描述： 9DB SERIES, PLL BASED CLOCK DRIVER, 8 TRUE OUTPUT(S), 0 INVERTED OUTPUT(S), PDSO48
封裝： ROHS COMPLIANT, SSOP-48
文件頁數(shù)： 4/18頁
文件大?。?/td> 226K
代理商： 9DB833AFILFT
9DB833
EIGHT OUTPUT DIFFERENTIAL BUFFER FOR PCIE GEN3
IDT
EIGHT OUTPUT DIFFERENTIAL BUFFER FOR PCIE GEN3
12
9DB833
REV C 052411
SMB us Table: Frequency Select Register, R EAD/WRITE ADDRESS (Selectable)
Pin #
Name
Control Function
Type
0
1
Default
Bit 7
PD_Mode
PD# drive mode
RW
driven
Hi-Z
1
Bit 6
OE_Mode
OE#_Stop drive mode
RW
driven
Hi-Z
0
Bit 5
0
Bit 4
X
Bit 3
MODE1
BYPASS#/PLL1
RW
Input
Bit 2
1
Bit 1
MODE0
BYPASS#/PLL0
RW
Input
Bit 0
SRC_DIV#
SRC D ivide by 2 Select
RW
x/2
x/1
1
SMB us Table: Output Control Register
Pin #
Name
Control Function
Type
0
1
Default
Bit 7
DIF_7
Output Enable
RW
Disable
Enable
1
Bit 6
DIF_6
Output Enable
RW
Disable
Enable
1
Bit 5
DIF_5
Output Enable
RW
Disable
Enable
1
Bit 4
DIF_4
Output Enable
RW
Disable
Enable
1
Bit 3
DIF_3
Output Enable
RW
Disable
Enable
1
Bit 2
DIF_2
Output Enable
RW
Disable
Enable
1
Bit 1
DIF_1
Output Enable
RW
Disable
Enable
1
Bit 0
DIF_0
Output Enable
RW
Disable
Enable
1
NOTE: The SMBus Output Enable Bit must be '1' AND the respective OE pin must be active for the output to run!
SMB us Table: OE Pin Control Register
Pin #
Name
Control Function
Type
0
1
Default
Bit 7
DIF_7
DIF_7 Stoppable with OE7#
RW
Free-run
Stoppable
0
Bit 6
DIF_6
DIF_6 Stoppable with OE6#
RW
Free-run
Stoppable
0
Bit 5
DIF_5
DIF_5 Stoppable with OE5#
RW
Free-run
Stoppable
0
Bit 4
DIF_4
DIF_4 Stoppable with OE4#
RW
Free-run
Stoppable
0
Bit 3
DIF_3
DIF_3 Stoppable with OE3#
RW
Free-run
Stoppable
0
Bit 2
DIF_2
DIF_2 Stoppable with OE2#
RW
Free-run
Stoppable
0
Bit 1
DIF_1
DIF_1 Stoppable with OE1#
RW
Free-run
Stoppable
0
Bit 0
DIF_0
DIF_0 Stoppable with OE0#
RW
Free-run
Stoppable
0
SMB us Table: Reserved Register
Pin #
Name
Control Function
Type
0
1
Default
Bit 7
X
Bit 6
X
Bit 5
X
Bit 4
X
Bit 3
X
Bit 2
X
Bit 1
X
Bit 0
X
Reserved
16,17
12,13
8,9
Byte 3
Byte 2
42,41
38,37
34,33
-
Byte 1
30,29
20,21
34,33
30,29
20,21
16,17
12,13
8,9
42,41
38,37
Byte 0
-
Reserved
SeeOperating Mode
Readback Table
SeeOperating Mode
Readback Table
相關(guān)PDF資料
PDF描述
9DB833AFLF 9DB SERIES, PLL BASED CLOCK DRIVER, 8 TRUE OUTPUT(S), 0 INVERTED OUTPUT(S), PDSO48
9DB833AFLFT 9DB SERIES, PLL BASED CLOCK DRIVER, 8 TRUE OUTPUT(S), 0 INVERTED OUTPUT(S), PDSO48
9DBL411AGLFT LOW SKEW CLOCK DRIVER, PDSO20
9DBL411AKLFT LOW SKEW CLOCK DRIVER, PQCC20
9DBL411AGLF LOW SKEW CLOCK DRIVER, PDSO20
相關(guān)代理商/技術(shù)參數(shù)
參數(shù)描述
9DB833AFLF 功能描述:時鐘緩沖器 8 OUTPUT PCIE GEN3 BUFFER RoHS:否 制造商:Texas Instruments 輸出端數(shù)量:5 最大輸入頻率:40 MHz 傳播延遲（最大值）: 電源電壓-最大:3.45 V 電源電壓-最小:2.375 V 最大功率耗散: 最大工作溫度:+ 85 C 最小工作溫度:- 40 C 封裝 / 箱體:LLP-24 封裝:Reel
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