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參數(shù)資料
| 型號： | 784218AY |
| 廠商： | NEC Corp. |
| 英文描述： | MOS INTEGRATED CIRCUIT |
| 中文描述： | 馬鞍山集成電路 |
| 文件頁數(shù)： | 81/100頁 |
| 文件大?。?/td> | 564K |
| 代理商： | 784218AY |
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Data Sheet U14121EJ2V0DS00
81
μ
PD784214A, 784215A, 784216A, 784217A, 784218A, 784214AY, 784215AY, 784216AY, 784217AY, 784218AY
www.DataSheet4U.com
A/D Converter Characteristics (T
A
=
40 to +85
°
C, V
DD
= AV
DD
= 1.8 to 5.5 V, V
SS
= AV
SS
= 0 V)
Parameter
Symbol
Conditions
MIN.
TYP.
MAX.
Unit
Resolution
8
8
8
bits
2.7 V
≤
V
DD
≤
5.5 V
2.2 V
≤
AV
REF0
≤
V
DD
±
1.2
%FSR
Overall error
Notes 1, 2
1.8 V
≤
V
DD
< 2.7 V
1.8 V
≤
AV
REF0
≤
V
DD
±
1.6
%FSR
Conversion time
t
CONV
14
144
μ
s
Sampling time
t
SAMP
24/f
XX
μ
s
Analog input voltage
V
IAN
AV
SS
AV
REF0
V
Reference voltage
AV
REF0
1.8
AV
DD
V
Resistance between AV
REF0
and AV
SS
R
AVREF0
When not A/D converting
40
k
Notes
1.
Quantization error (
±
1/2 LSB) is not included.
2.
Overall error is indicated as a ratio to the full-scale value.
Remark
f
XX
: Main system clock frequency
D/A Converter Characteristics (T
A
=
40 to +85
°
C, V
DD
= AV
DD
= 1.8 to 5.5 V, V
SS
= AV
SS
= 0 V)
Parameter
Symbol
Conditions
MIN.
TYP.
MAX.
Unit
Resolution
8
8
8
Bits
R = 10 M
, 2.0 V
≤
AV
REF1
≤
V
DD
,
2.0 V
≤
V
DD
≤
5.5 V
±
0.6
%FSR
Overall error
Notes 1, 2
R = 10 M
, 1.8 V
≤
AV
REF1
≤
V
DD
,
1.8 V
≤
V
DD
≤
2.0 V
±
1.2
%FSR
4.5 V
≤
AV
REF1
≤
5.5 V
10
μ
s
2.7 V
≤
AV
REF1
< 4.5 V
15
μ
s
Settling time
Load conditions:
C = 30 pF
1.8 V
≤
AV
REF1
< 2.7 V
20
μ
s
Output resistance
R
O
DACS0, 1 = 55H
8
k
Reference voltage
AV
REF1
1.8
V
DD
V
AV
REF1
current
AI
REF1
For only 1 channel
2.5
mA
Notes
1.
Quantization error (
±
1/2 LSB) is not included.
2.
Overall error is indicated as a ratio to the full-scale value.
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參數(shù)描述 |
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