參數(shù)資料
型號： 7700
英文描述： 12-bit ADC, SPI, 4-channel, -40C to +85C, 14-SOIC 150mil, T/R
中文描述： 7700系列軟件MANUALProgramming手冊
文件頁數(shù)： 217/361頁
文件大?。?/td> 2709K
代理商： 7700
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7700 FAMILY SOFTWARE MANUAL
5–4
INST R UCT ION E X E CUT ION SE QUE NCE
5.2 Instruction execution sequence
The following are the cause of the “
φ
CPU
to queue” in the
φ
based instruction execution sequence.
Cause 1
When the CPU required operation codes and operands, but the number of operation codes and operands did
not reach the requested number.
Cause 2
When the CPU tried to access data, but the bus interface was using the bus for fetching data into the instruction
queue buffer or for writing data.
Cause 3
When the bus interface unit is reading data from the internal/external memory or I/O, etc., according to the
request of the CPU.
Before observing the
φ
based instruction execution sequence
The
φ
based instruction execution sequence symbols are shown in the following table. The signals in this
execution sequence indicates data exchange of the bus interface unit with the memory and I/O. The internal
instruction execution sequence of the CPU can be guessed from these signals.
However, the
φ
CPU
and the number of data in the instruction queue buffer shown here cannot be observed from
the outside.
φ
Based Execution Sequence Symbols
Symbol
φ
E
hh
mm
ll
DPR
Description
Basic operation clock of the microcomputer (divided by 2 of f(X
IN
) )
Basic operation clock of the bus (divided by 2 of
φ
)
Higher order 8 bits of the address where the bus interface unit is to access to (bank)
Middle order 8 bits of the address where the bus interface unit is to access to
Lower order 8 bits of the address where the bus interface unit is to access to
Contents of the direct page
Contents of the higher order 8 bits of the direct page register
Contents of the lower order 8 bits of the direct page register
Data to be fetched into the instruction queue buffer by the bus interface
E
No wait
DPR
H
DPR
L
OP
1
OP
2
OP
3
:
D
L
D
H
dd
(Operation code or operand)
The subscript represents the fetch sequence.
Data to be fetched into the data buffer or data to be written into the memory by the bus interface unit
Data obtained as the operand (The lower order 8 bits of the address are given in examples 1 and
2, because DPR
L
= 0.)
Higher order 8 bits of data that indicates the address (contents of the data address register)
Middle order 8 bits of data that indicates the address (contents of the data address register)
Lower order 8 bits of data that indicates the address (contents of the data address register)
AD
P
AD
H
AD
L
相關(guān)PDF資料
PDF描述
77010012X 5V, SINGLE CHANNEL, 12 BIT SERIAL A/D CONVERTER, -40C to +125C, 5-SOT-23, T/R
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參數(shù)描述
7700 BK199 制造商:Belden Inc 功能描述:7700 BLACK BULK FT
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7700/10 100'SF 功能描述:CBL RIBN 10COND .025 SILVER 100' 制造商:3m 系列:7700 零件狀態(tài):在售 電纜類型:扁平纜線 導(dǎo)體數(shù):10 間距:0.025"（0.64mm） 長度:100.0'（30.48m） 線規(guī):30 AWG 導(dǎo)線股數(shù):實心 屏蔽:無屏蔽 套管顏色:銀色 帶厚度:0.030"（0.76mm） 帶寬度:0.300"（7.62mm） 護套（絕緣）材料:聚烯烴（PO） 電壓:30V 工作溫度:-20°C ~ 80°C 等級:- 特性:- 導(dǎo)體材料:銅，鍍錫 絕緣電阻:1 G歐姆 第一導(dǎo)體標志:- 標準包裝:10
7700/100 100' 功能描述:CBL RIBN 100COND .025 SLVR 100' 制造商:3m 系列:7700 零件狀態(tài):在售 電纜類型:扁平纜線 導(dǎo)體數(shù):100 間距:0.025"（0.64mm） 長度:100.0'（30.48m） 線規(guī):30 AWG 導(dǎo)線股數(shù):實心 屏蔽:無屏蔽 套管顏色:銀色 帶厚度:0.030"（0.76mm） 帶寬度:2.550"（64.77mm） 護套（絕緣）材料:聚烯烴（PO） 電壓:30V 工作溫度:-20°C ~ 80°C 等級:- 特性:- 導(dǎo)體材料:銅，鍍錫 絕緣電阻:1 G歐姆 第一導(dǎo)體標志:- 標準包裝:6
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