參數(shù)資料
型號: 74VHCT374AMTCX
廠商: Fairchild Semiconductor
文件頁數(shù): 5/9頁
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描述: IC FLIP FLOP OCT D 2ST 20TSSOP
標準包裝: 1
系列: 74VHCT
功能: 標準
類型: D 型總線
輸出類型: 三態(tài)非反相
元件數(shù): 1
每個元件的位元數(shù): 8
頻率 - 時鐘: 130MHz
延遲時間 - 傳輸: 5.6ns
觸發(fā)器類型: 正邊沿
輸出電流高,低: 8mA,8mA
電源電壓: 4.5 V ~ 5.5 V
工作溫度: -40°C ~ 85°C
安裝類型: 表面貼裝
封裝/外殼: 20-TSSOP(0.173",4.40mm 寬)
包裝: 標準包裝
其它名稱: 74VHCT374AMTCXDKR
74VHCT374A
Octal
D-T
ype
Flip-Flop
with
3-ST
A
TE
Outputs
1997 Fairchild Semiconductor Corporation
www.fairchildsemi.com
74VHCT374A Rev. 1.3
5
AC Electrical Characteristics
Notes:
7. Parameter guaranteed by design. tOSLH = |tPLH max – tPLH min|; tOSHL = |tPHL max – tPHL min|
8. CPD is defined as the value of the internal equivalent capacitance which is calculated from the operating
current consumption without load. Average operating current can be obtained by the equation:
ICC (Opr.) = CPD VCC fIN + ICC / 8 (per F/F). The total CPD when n pcs. of the octal D Flip-Flop operates
can be calculated by the equation: CPD(total) = 20 + 12m
AC Operating Requirements
Symbol
Parameter
VCC (V)
Conditions
TA = 25°C
TA = –40°C
to +85°C
Units
Min.
Typ. Max. Min.
Max.
tPLH, tPHL
Propagation Delay
Time
5.0 ± 0.5
CL = 15pF
4.1
9.4
1.0
10.5
ns
CL = 50pF
5.6
10.4
1.0
11.5
tPZL, tPZH
3-STATE Output
Enable Time
5.0 ± 0.5
RL = 1k CL = 15pF
6.5
10.2
1.0
11.5
ns
CL = 50pF
7.3
11.2
1.0
12.5
tPLZ, tPHZ
3-STATE Output
Disable Time
5.0 ± 0.5
RL = 1k CL = 50pF
7.0
11.2
1.0
12.0
ns
tOSLH, tOSHL Output to Output
Skew
5.0 ± 0.5 (7)
1.0
ns
fMAX
Maximum Clock
Frequency
5.0 ± 0.5
CL = 15pF
90
140
80
MHz
CL = 50pF
85
130
75
CIN
Input Capacitance
VCC = Open
4
10
pF
COUT
Output Capacitance
VCC = 5.0V
9
pF
CPD
Power Dissipation
Capacitance
(8)
25
pF
Symbol
Parameter
VCC (V)
TA = 25°C
TA = –40°C to +85°C
Units
Min.
Typ.
Max.
Min.
Max.
tW(H), tW(L) Minimum Pulse Width (CP)
5.0 ± 0.5
6.5
8.5
ns
tS
Minimum Set-up Time
5.0 ± 0.5
2.5
ns
tH
Minimum Hold Time
5.0 ± 0.5
2.5
ns
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