參數資料
型號： 74VHCT373A
廠商： Fairchild Semiconductor Corporation
英文描述： Octal D-Type Latch with 3-STATE Outputs
中文描述： 八路D類鎖存器與三態(tài)輸出
文件頁數： 4/10頁
文件大小： 73K
代理商： 74VHCT373A
DC SPECIFICATIONS
Symbol
Parameter
Test Conditions
V
CC
(V)
Value
Unit
T
A
= 25
o
C
Min.
Typ.
2
-40 to 85
o
C
Min.
2
Max.
Max.
V
IH
High Level Input
Voltage
Low Level Input
Voltage
High Level Output
Voltage
4.5 to 5.5
V
V
IL
4.5 to 5.5
0.8
0.8
V
V
OH
4.5
4.5
4.5
4.5
I
O
=-50
μ
A
I
O
=-8 mA
I
O
=50
μ
A
I
O
=8 mA
V
I
= V
IH
or V
IL
V
O
= 0V to 5.5V
4.4
3.94
4.5
4.4
3.8
V
V
OL
Low Level Output
Voltage
0.0
0.1
0.36
±
0.25
0.1
0.44
±
2.5
V
I
OZ
High Impedance
Output Leakage
Current
Input Leakage Current
Quiescent Supply
Current
Additional Worst Case
Supply Current
4.5 to 5.5
μ
A
I
I
0 to 5.5
5.5
V
I
= 5.5V or GND
V
I
= V
CC
orGND
±
0.1
4
±
1.0
40
μ
A
μ
A
I
CC
I
CC
5.5
One Input at 3.4V,
other input at V
CC
or
GND
V
OUT
= 5.5V
1.35
1.5
mA
I
OPD
Output Leakage
Current
0
0.5
5.0
μ
A
AC ELECTRICAL CHARACTERISTICS
(Inputt
r
= t
f
=3 ns)
Symbol
Parameter
Test Condition
C
L
(pF)
5.0
(*)
15
5.0
(*)
50
5.0
(*)
15
5.0
(*)
50
5.0
(*)
15
5.0
(*)
50
5.0
(*)
50
Value
Unit
V
CC
(V)
T
A
= 25
o
C
Min.
Typ.
-40 to 85
o
C
Min.
1.0
1.0
1.0
1.0
1.0
1.0
1.0
Max.
12.3
13.3
8.5
9.5
10.9
11.9
11.2
Max.
13.5
14.5
9.5
10.5
12.5
13.5
12.0
t
PLH
t
PHL
Propagation Delay
Time LE to Q
5.4
6.0
6.4
7.1
6.2
6.9
6.7
ns
t
PLH
t
PHL
Propagation Delay
Time D to Q
ns
t
PZL
t
PZH
Output EnableTime
R
L
= 1K
ns
t
PLZ
t
PHZ
t
w
Output Disable Time
R
L
= 1K
ns
Pulse Width (LE)
HIGH
Setup Time D to LE
HIGH or LOW
Hold Time D toLE
HIGH or LOW
Output to Output Skew
Time (note 1)
(*) Voltagerangeis5V
±
0.5V
Note1:Parameter guaranteed bydesign. t
soLH
=|t
pLHm
-t
pLHn
|,t
soHL
=|t
pHLm
-t
pHLn
|
5.0
(*)
6.5
8..5
ns
t
s
5.0
(*)
1.5
1.5
ns
t
h
5.0
(*)
3.5
3.5
ns
t
OSLH
t
OSHL
5.0
(*)
50
1.0
1.0
ns
74VHCT373A
4/10
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