參數(shù)資料
型號： 74LVX594TTR
廠商： 意法半導(dǎo)體
元件分類： 通用總線功能
英文描述： LOW VOLTAGE CMOS 8 BIT SHIFT REGISTER WITH OUTPUT REGISTER (5V TOLERANT INPUTS)
中文描述： 低電壓CMOS 8位元移位寄存器與輸出寄存器（5V容限輸入）
文件頁數(shù)： 6/14頁
文件大?。?/td> 307K
代理商： 74LVX594TTR
74LVX594
6/14
Table 8: AC Electrical Characteristics
(Input t
r
= t
f
= 3ns)
1) Skew is defined as the absolute value of the difference between the actual propagation delay for any two outputs of the same device switch-
ing in the same direction, either HIGH or LOW
2) Parameter guaranteed by design
(*) Voltage range is 3.3V
±
0.3V
Symbol
Parameter
Test Condition
Value
Unit
V
CC
(V)
C
L
(pF)
T
A
= 25°C
-40 to 85°C
-55 to 125°C
Min.
Typ.
Max.
Min.
Max.
Min.
Max.
t
PLH
t
PHL
Propagation Delay
Time
(RCK - Qn)
2.7
2.7
3.3
(*)
3.3
(*)
2.7
2.7
3.3
(*)
3.3
(*)
2.7
2.7
3.3
(*)
3.3
(*)
2.7
2.7
3.3
(*)
3.3
(*)
2.7
2.7
3.3
(*)
3.3
(*)
2.7
3.3
(*)
2.7
3.3
(*)
15
50
15
5.5
9.0
4.9
9.5
13.0
8.2
1.0
1.0
1.0
10.0
14.5
8.8
1.0
1.0
1.0
10.0
14.5
8.8
ns
50
15
50
15
8.1
6.5
9.2
5.5
11.9
11.0
14.0
9.2
1.0
1.0
1.0
1.0
13.1
12.5
16.0
9.9
1.0
1.0
1.0
1.0
13.1
12.5
16.0
9.9
t
PLH
t
PHL
Propagation Delay
Time
(SCK - QH’)
ns
50
15
50
15
8.4
7.3
10.5
6.0
12.5
11.0
14.5
9.8
1.0
1.0
1.0
1.0
13.9
13.0
16.0
10.6
1.0
1.0
1.0
1.0
13.9
13.0
16.0
10.6
t
PHL
Propagation Delay
Time
(RCLR - Qn)
ns
50
15
50
15
9.0
6.3
9.0
5.6
13.1
10.5
13.5
9.2
1.0
1.0
1.0
1.0
14.4
12.0
15.5
10.0
1.0
1.0
1.0
1.0
14.4
12.0
15.5
10.0
t
PLH
t
PHL
Propagation Delay
Time
(SCLR - QH’)
ns
50
15
50
15
8.5
110
90
120
12.4
1.0
60
35
70
14.0
1.0
60
35
70
14.0
f
MAX
Maximum Clock
Frequency
70
40
80
MHz
50
50
50
50
55
6.5
5.5
5.0
105
50
6.5
5.5
5.0
50
6.5
5.5
5.0
t
W(H)
Minimum Pulse
Width (SCK, RCK)
ns
t
W(L)
Minimum Pulse
Width
(SCLR,RCLR)
ns
50
5.0
5.0
5.0
t
s
Minimum Set-Up
Time (SI - CCK)
2.7
3.3
(*)
2.7
3.3
(*)
2.7
3.3
(*)
2.7
3.3
(*)
2.7
3.3
(*)
2.7
3.3
(*)
50
50
50
50
50
50
50
50
50
50
50
3.5
3.0
9.0
85.
8.0
7.5
1.5
1.5
3.0
3.0
3.5
3.0
9.0
8.5
8.0
7.5
1.5
1.5
3.0
3.0
3.5
3.0
9.0
8.5
8.0
7.5
1.5
1.5
3.0
3.0
ns
t
s
Minimum Set - Up
Time (SCK, RCK)
ns
t
s
Minimum Set - Up
Time (SCRL - RCK)
ns
t
h
Minimum Hold
Time
ns
t
REM
Minimum Clear
Removal Time
ns
t
OSLH
t
OSHL
Output To Output
Skew Time (note1,
2)
0.5
0.5
1.0
1.0
1.5
1.5
1.5
1.5
ns
50
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