參數(shù)資料
型號： 74LVTH16646MTDX
廠商： Fairchild Semiconductor
文件頁數(shù)： 7/9頁
文件大小： 0K
描述： IC TRANSCVR TRI-ST 16BIT 56TSSOP
標準包裝： 1,000
系列： 74LVTH
邏輯類型： 寄存收發(fā)器，非反相
元件數(shù)： 2
每個元件的位元數(shù)： 8
輸出電流高，低： 32mA，64mA
電源電壓： 2.7 V ~ 3.6 V
工作溫度： -40°C ~ 85°C
安裝類型： 表面貼裝
封裝/外殼： 56-TFSOP（0.240"，6.10mm 寬）
供應(yīng)商設(shè)備封裝： 56-TSSOP
包裝： 帶卷 (TR)
7
www.fairchildsemi.com
7
4
L
V
T1
6646
74L
VTH16646
AC Electrical Characteristics
Note 10: Skew is defined as the absolute value of the difference between the actual propagation delay for any two separate outputs of the same device. The
specification applies to any outputs switching in the same direction, either HIGH-to-LOW (tOSHL) or LOW-to-HIGH (tOSLH).
Capacitance (Note 11)
Note 11: Capacitance is measured at frequency f
= 1 MHz, per MIL-STD-883, Method 3012.
Symbol
Parameter
TA = 40°C to +85°C
Units
CL = 50 pF, RL = 500
VCC = 3.3 ± 0.3V
VCC = 2.7V
Min
Max
Min
Max
fMAX
Maximum Clock Frequency
150
MHz
tPLH
Propagation Delay
1.3
5.4
1.3
5.9
ns
tPHL
CPAB or CPBA to A or B
1.3
5.2
1.3
5.8
tPLH
Propagation Delay
1.0
4.4
1.0
4.7
ns
tPHL
Data to A or B
1.0
4.6
1.0
5.1
tPLH
Propagation Delay
1.0
4.6
1.0
5.4
ns
tPHL
SBA or SAB to A or B
1.0
4.8
1.0
5.6
tPZH
Output Enable Time
1.0
4.7
1.0
5.4
ns
tPZL
OE to A or B
1.0
5.1
1.0
6.0
tPHZ
Output Disable Time
2.0
5.6
2.0
6.1
ns
tPLZ
OE to A or B
2.0
5.4
2.0
6.1
tPZH
Output Enable Time
1.0
4.9
1.0
5.4
ns
tPZL
DIR to A or B
1.0
5.4
1.0
6.4
tPHZ
Output Disable Time
1.5
6.4
1.5
7.1
ns
tPLZ
DIR to A or B
1.5
5.4
1.5
5.9
tW
Pulse Duration
CPAB or CPBA HIGH or LOW
3.3
ns
tS
Setup Time
A or B before CPAB or CPBA, Data HIGH
1.2
1.5
ns
A or B before CPAB or CPBA, Data LOW
2.0
2.8
tH
Hold Time
A or B after CPAB or CPBA, Data HIGH
0.5
0.0
ns
A or B after CPAB or CPBA, Data LOW
0.5
tOSHL
Output to Output Skew (Note 10)
1.0
ns
tOSLH
1.0
Symbol
Parameter
Conditions
Typical
Units
CIN
Input Capacitance
VCC = Open, VI = 0V or VCC
4pF
CI/O
Input/Output Capacitance
VCC = 3.0V, VO = 0V or VCC
8pF
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