參數(shù)資料
型號： 74LVT273
廠商： NXP Semiconductors N.V.
英文描述： 3.3V Octal D flip-flop(3.3V 八 D觸發(fā)器)
中文描述： 3.3八路D觸發(fā)器（3.3八?觸發(fā)器）
文件頁數(shù)： 2/11頁
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代理商： 74LVT273
Philips Semiconductors
Product specification
74LVT273
3.3V Octal D flip-flop
2
1998 Feb 19
853-1740 18985
FEATURES
Eight edge-triggered D-type flip-flops
Buffered common clock
Buffered asynchronous Master Reset
Output capability: +64mA/–32mA
TTL input and output switching levels
Input and output interface capability to systems at 5V supply
Bus-hold data inputs eliminate the need for external pull-up
resistors to hold unused inputs
Power-up reset
Live insertion/extraction permitted
No bus current loading when output is tied to 5V bus
Latchup protection exceeds 500 mA per JEDEC Std 17
ESD protection exceeds 2000V per Mil Std 883 Method 3015 and
200V per Machine Model.
DESCRIPTION
The LVT273 is a high-performance BiCMOS product designed for
V
CC
operation at 3.3V.
This device has eight edge-triggered D-type flip-flops with individual
D inputs and Q outputs. The common buffered Clock (CP) and
Master Reset (MR) inputs load and reset (clear) all flip-flops
simultaneously.
The register is fully edge-triggered. The state of each D input, one
setup time before the Low-to-High clock transition, is transferred to
the corresponding flip-flop’s Q output.
All outputs will be forced Low independent of Clock or Data inputs
by a Low voltage level on the MR input. The device is useful for
applications where the true output only is required and the CP and
MR are common elements.
QUICK REFERENCE DATA
SYMBOL
PARAMETER
CONDITIONS
T
amb
= 25
°
C; GND = 0V
TYPICAL
UNIT
t
PLH
t
PHL
Propagation delay
CP to Qn
C
L
= 50pF; V
CC
= 3.3V
3.5
3.5
ns
C
IN
Input capacitance
V
I
= 0V or 3.0V
4
pF
ORDERING INFORMATION
PACKAGES
20-Pin Plastic SOL
20-Pin Plastic SSOP Type II
20-Pin Plastic TSSOP Type I
TEMPERATURE RANGE
–40
°
C to +85
°
C
–40
°
C to +85
°
C
–40
°
C to +85
°
C
OUTSIDE NORTH AMERICA
74LVT273 D
74LVT273 DB
74LVT273 PW
NORTH AMERICA
74LVT273 D
74LVT273 DB
74LVT273PW DH
DWG NUMBER
SOT163-1
SOT339-1
SOT360-1
PIN CONFIGURATION
1
2
3
4
5
6
7
8
9
10
11
12
13
14
15
16
17
18
19
20
MR
Q0
D0
D1
Q1
Q2
D2
D3
Q3
Q4
GND
D4
D5
Q5
Q6
D6
D7
Q7
V
CC
CP
SV00017
LOGIC SYMBOL
3
4
7
8
13
14
18
17
D0 D1 D2 D3 D4 D5 D6 D7
Q0 Q1 Q2 Q3 Q4 Q5 Q6 Q7
2
5
6
9
12
15
16
19
1
11
MR
CP
SV00018
相關(guān)PDF資料
PDF描述
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