參數(shù)資料
型號： 74LVC273D,112
廠商： NXP Semiconductors
文件頁數(shù)： 15/17頁
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描述： IC OCT D FF POSEDG TRIG 20SOIC
產品培訓模塊： Logic Packages
標準包裝： 1,520
系列： 74LVC
功能： 主復位
類型： D 型總線
輸出類型： 非反相
元件數(shù)： 1
每個元件的位元數(shù)： 8
頻率 - 時鐘： 150MHz
延遲時間 - 傳輸： 1.5ns
觸發(fā)器類型： 正邊沿
輸出電流高，低： 24mA，24mA
電源電壓： 1.2 V ~ 3.6 V
工作溫度： -40°C ~ 125°C
安裝類型： 表面貼裝
封裝/外殼： 20-SOIC（0.295"，7.50mm 寬）
包裝： 管件
74LVC273
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NXP B.V. 2012. All rights reserved.
Product data sheet
Rev. 6 — 31 December 2012
7 of 17
NXP Semiconductors
74LVC273
Octal D-type flip-flop with reset; positive-edge trigger
[1]
Typical values are measured at Tamb =25 C and VCC = 1.2 V, 1.8 V, 2.5 V, 2.7 V and 3.3 V respectively.
[2]
tpd is the same as tPLH and tPHL.
[3]
Skew between any two outputs of the same package switching in the same direction. This parameter is guaranteed by design.
[4]
CPD is used to determine the dynamic power dissipation (PD in W).
PD =CPD VCC2 fi N+ (CL VCC2 fo) where:
fi = input frequency in MHz; fo = output frequency in MHz
CL = output load capacitance in pF
VCC = supply voltage in Volt
N = number of inputs switching
(C
L VCC
2
f
o) = sum of the outputs
11. Waveforms
fmax
maximum
frequency
VCC = 1.65 V to 1.95 V
80
-
64
-
MHz
VCC = 2.3 V to 2.7 V
100
-
80
-
MHz
VCC = 2.7 V
150
-
150
-
MHz
VCC = 3.0 V to 3.6 V
150
230
-
150
-
MHz
tsk(o)
output skew time
VCC = 3.0 V to 3.6 V
-
1.0
-
1.5
ns
CPD
power dissipation
capacitance
per flip-flop; VI = GND to VCC
VCC = 1.65 V to 1.95 V
-
14.0
-
pF
VCC = 2.3 V to 2.7 V
-
17.7
-
pF
VCC = 3.0 V to 3.6 V
-
21.0
-
pF
Table 7.
Dynamic characteristics …continued
Voltages are referenced to GND (ground = 0 V). For test circuit see Figure 8.
Symbol Parameter
Conditions
40 C to +85 C
40 C to +125 C Unit
Min
Typ[1]
Max
Min
Max
Measurement points are given in Table 8.
VOL and VOH are typical output voltage levels that occur with the output load.
Fig 5.
Clock (CP) to output (Qn) propagation delays, the clock pulse width, and the maximum frequency
mna765
CP input
Qn output
tPHL
tPLH
tW
VM
VOH
VI
GND
VOL
VM
1/fmax
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PDF描述
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