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參數(shù)資料
| 型號(hào)： | 74LVC1G80GV,125 |
| 廠商： | NXP Semiconductors |
| 文件頁(yè)數(shù)： | 1/21頁(yè) |
| 文件大?。?/td> | 0K |
| 描述： | IC SNGL D FF POSEDG TRIG SC74A-5 |
| 產(chǎn)品培訓(xùn)模塊： | Logic Packages |
| 標(biāo)準(zhǔn)包裝： | 1 |
| 系列： | 74LVC |
| 功能： | 標(biāo)準(zhǔn) |
| 類型： | D 型 |
| 輸出類型： | 反相 |
| 元件數(shù)： | 1 |
| 每個(gè)元件的位元數(shù)： | 1 |
| 頻率 - 時(shí)鐘： | 400MHz |
| 延遲時(shí)間 - 傳輸： | 1.8ns |
| 觸發(fā)器類型： | 正邊沿 |
| 輸出電流高，低： | 32mA，32mA |
| 電源電壓： | 1.65 V ~ 5.5 V |
| 工作溫度： | -40°C ~ 125°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | SC-74A，SOT-753 |
| 包裝： | 標(biāo)準(zhǔn)包裝 |
| 其它名稱： | 568-7772-6 |
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1.
General description
The 74LVC1G80 provides a single positive-edge triggered D-type flip-flop.
Information on the data input is transferred to the Q output on the LOW-to-HIGH transition
of the clock pulse. The input pin D must be stable one set-up time prior to the
LOW-to-HIGH clock transition for predictable operation.
Inputs can be driven from either 3.3 V or 5 V devices. This feature allows the use of this
device in a mixed 3.3 V and 5 V environment.
This device is fully specified for partial power-down applications using IOFF. The IOFF
circuitry disables the output, preventing the damaging backflow current through the device
when it is powered down.
2.
Features and benefits
Wide supply voltage range from 1.65 V to 5.5 V
High noise immunity
Complies with JEDEC standard:
JESD8-7 (1.65 V to 1.95 V)
JESD8-5 (2.3 V to 2.7 V)
JESD8B/JESD36 (2.7 V to 3.6 V)
ESD protection:
HBM JESD22-A114F exceeds 2000 V
MM JESD22-A115-A exceeds 200 V
24 mA output drive (V
CC =3.0 V)
CMOS low power consumption
Latch-up performance exceeds 250 mA
Direct interface with TTL levels
Inputs accept voltages up to 5 V
Multiple package options
Specified from
40 Cto+85 C and 40 Cto+125 C.
74LVC1G80
Single D-type flip-flop; positive-edge trigger
Rev. 12 — 2 July 2012
Product data sheet
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| 74LVC273D,112 | IC OCT D FF POSEDG TRIG 20SOIC |
| 74LVC2G74DP,125 | IC SNGL D FF POS-EDG TRIG 8TSSOP |
| 74LVC374APW,118 | IC OCT D FF POS-EDG TRIG 20TSSOP |
| 74LVC377PW,118 | IC OCT D-TYPE FLIP-FLOP 20TSSOP |
| 74LVC543ABQ,115 | IC REGISTERED TXRX 8BIT 24QFN |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| 74LVC1G80GV-Q100,1 | 制造商:NXP Semiconductors 功能描述:Flip Flop D-Type Pos-Edge 1-Element 5-Pin TSOP 制造商:NXP Semiconductors 功能描述:74LVC1G80GV-Q100/SO5/REELR// - Tape and Reel 制造商:NXP Semiconductors 功能描述:IC FLIP FLOP SGL D POS 5TSOP |
| 74LVC1G80GV-Q100,125 | 制造商:NXP Semiconductors 功能描述: |
| 74LVC1G80GW | 制造商:PANASONIC 制造商全稱:Panasonic Semiconductor 功能描述:Single D-type flip-flop; positive-edge trigger |
| 74LVC1G80GW,125 | 功能描述:觸發(fā)器 3.3V PICOGATE D-TYPE RoHS:否 制造商:Texas Instruments 電路數(shù)量:2 邏輯系列:SN74 邏輯類型:D-Type Flip-Flop 極性:Inverting, Non-Inverting 輸入類型:CMOS 輸出類型: 傳播延遲時(shí)間:4.4 ns 高電平輸出電流:- 16 mA 低電平輸出電流:16 mA 電源電壓-最大:5.5 V 最大工作溫度:+ 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:X2SON-8 封裝:Reel |
| 74LVC1G80GW,165 | 功能描述:觸發(fā)器 SINGLE D-TYPE RoHS:否 制造商:Texas Instruments 電路數(shù)量:2 邏輯系列:SN74 邏輯類型:D-Type Flip-Flop 極性:Inverting, Non-Inverting 輸入類型:CMOS 輸出類型: 傳播延遲時(shí)間:4.4 ns 高電平輸出電流:- 16 mA 低電平輸出電流:16 mA 電源電壓-最大:5.5 V 最大工作溫度:+ 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:X2SON-8 封裝:Reel |
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