參數(shù)資料
型號： 74HCT563
廠商： NXP Semiconductors N.V.
元件分類： 通用總線功能
英文描述： 4-Bit Synchronous Up/Down Counters (Dual Clock With Clear) 16-SOIC -40 to 85
中文描述： 八路D型透明鎖存器，三態(tài);反相
文件頁數(shù)： 7/7頁
文件大?。?/td> 63K
代理商： 74HCT563
December 1990
7
Philips Semiconductors
Product specification
Octal D-type transparent latch; 3-state;
inverting
74HC/HCT563
AC WAVEFORMS
Fig.6
Waveforms showing the data input (D
n
) to
output (Q
n
) propagation delays and the
output transition times.
(1) HC : V
M
= 50%; V
I
= GND to V
.
HCT: V
M
= 1.3 V; V
I
= GND to 3 V.
Fig.7
Waveforms showing the latch enable input
(LE) pulse width, the latch enable input to
output (Q
n
) propagation delays and the
output transition times.
(1) HC : V
M
= 50%; V
I
= GND to V
.
HCT: V
M
= 1.3 V; V
I
= GND to 3 V.
Fig.8
Waveforms showing the 3-state enable and
disable times.
(1) HC : V
M
= 50%; V
I
= GND to V
.
HCT: V
M
= 1.3 V; V
I
= GND to 3 V.
PACKAGE OUTLINES
See
“74HC/HCT/HCU/HCMOS Logic Package Outlines”
.
Fig.9
Waveforms showing the data set-up and
hold times for D
n
input to LE input
The shaded areas indicate when the input is permitted to
change for predictable output performance.
(1) HC : V
M
= 50%; V
I
= GND to V
.
HCT: V
M
= 1.3 V; V
I
= GND to 3 V.
相關PDF資料
PDF描述
74HC563 Octal D-type transparent latch; 3-state; inverting
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74HCT564 4-Bit Synchronous Up/Down Counters (Dual Clock With Clear) 16-SOIC -40 to 85
74HC564 Octal D-type flip-flop; positive-edge trigger; 3-state; inverting
相關代理商/技術參數(shù)
參數(shù)描述
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