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參數(shù)資料
| 型號： | 74HC73DB,118 |
| 廠商： | NXP Semiconductors |
| 文件頁數(shù)： | 1/12頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC DUAL JK F-F NEG EDGE 14SSOP |
| 產(chǎn)品培訓(xùn)模塊： | Logic Packages |
| 標(biāo)準(zhǔn)包裝： | 2,000 |
| 系列： | 74HC |
| 功能： | 復(fù)位 |
| 類型： | JK 型 |
| 輸出類型： | 差分 |
| 元件數(shù)： | 2 |
| 每個元件的位元數(shù)： | 1 |
| 頻率 - 時鐘： | 77MHz |
| 延遲時間 - 傳輸： | 15ns |
| 觸發(fā)器類型： | 負(fù)邊沿 |
| 輸出電流高，低： | 5.2mA，5.2mA |
| 電源電壓： | 2 V ~ 6 V |
| 工作溫度： | -40°C ~ 125°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 14-SSOP（0.209"，5.30mm 寬） |
| 包裝： | 帶卷 (TR) |
| 其它名稱： | 74HC73DB-T 74HC73DB-T-ND 935190270118 |
1.
General description
The 74HC73 is a high-speed Si-gate CMOS device that complies with JEDEC
standard no. 7A. It is pin compatible with Low-power Schottky TTL (LSTTL).
The 74HC73 is a dual negative-edge triggered JK ip-op featuring individual J, K, clock
(nCP) and reset (nR) inputs; also complementary nQ and nQ outputs.
The J and K inputs must be stable one set-up time prior to the HIGH-to-LOW clock
transition for predictable operation.
The reset (nR) is an asynchronous active LOW input. When LOW, it overrides the clock
and data inputs, forcing the nQ output LOW and the nQ output HIGH.
Schmitt-trigger action in the clock input makes the circuit highly tolerant to slower clock
rise and fall times.
2.
Features
I Low-power dissipation
I Complies with JEDEC standard no. 7A
I ESD protection:
N HBM JESD22-A114E exceeds 2000 V
N MM JESD22-A115-A exceeds 200 V
I Multiple package options
I Specied from 40 °Cto+80 °C and from 40 °C to +125 °C
3.
Ordering information
74HC73
Dual JK ip-op with reset; negative-edge trigger
Rev. 04 — 19 March 2008
Product data sheet
Table 1.
Ordering information
Type number
Package
Temperature range Name
Description
Version
74HC73N
40 °C to +125 °C
DIP14
plastic dual in-line package; 14 leads (300 mil)
SOT27-1
74HC73D
40 °C to +125 °C
SO14
plastic small outline package; 14 leads; body width 3.9 mm
SOT108-1
74HC73DB
40 °C to +125 °C
SSOP14
plastic shrink small outline package; 14 leads; body width
5.3 mm
SOT337-1
74HC73PW
40 °C to +125 °C
TSSOP14 plastic thin shrink small outline package; 14 leads; body
width 4.4 mm
SOT402-1
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| 74LVC1G74GF,115 | IC FLIP-FLOP SGL D S/R XSON8 |
| VI-B4X-MU-F3 | CONVERTER MOD DC/DC 5.2V 200W |
| TXR21AB90-2216BI | ADPTR TINEL LOCK ANG SHELL 22 |
| VI-B63-MU-F3 | CONVERTER MOD DC/DC 24V 200W |
| TXR18AB45-2420AI | ADPTR TINEL LOCK ANG SHELL 24 |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| 74HC73DB-T | 功能描述:觸發(fā)器 DUAL J-K MASTR-SLAVE RoHS:否 制造商:Texas Instruments 電路數(shù)量:2 邏輯系列:SN74 邏輯類型:D-Type Flip-Flop 極性:Inverting, Non-Inverting 輸入類型:CMOS 輸出類型: 傳播延遲時間:4.4 ns 高電平輸出電流:- 16 mA 低電平輸出電流:16 mA 電源電壓-最大:5.5 V 最大工作溫度:+ 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:X2SON-8 封裝:Reel |
| 74HC73M | 制造商:HARRIS 功能描述:74HC73 |
| 74HC73N | 制造商:NXP Semiconductors 功能描述:Tube 制造商:NXP Semiconductors 功能描述:Flip Flop JK-Type Neg-Edge 2-Element 14-Pin PDIP |
| 74HC73N,652 | 功能描述:觸發(fā)器 DUAL J-K FLIP FLOP RoHS:否 制造商:Texas Instruments 電路數(shù)量:2 邏輯系列:SN74 邏輯類型:D-Type Flip-Flop 極性:Inverting, Non-Inverting 輸入類型:CMOS 輸出類型: 傳播延遲時間:4.4 ns 高電平輸出電流:- 16 mA 低電平輸出電流:16 mA 電源電壓-最大:5.5 V 最大工作溫度:+ 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:X2SON-8 封裝:Reel |
| 74HC73PW | 功能描述:觸發(fā)器 DUAL J-K MASTR-SLAVE RoHS:否 制造商:Texas Instruments 電路數(shù)量:2 邏輯系列:SN74 邏輯類型:D-Type Flip-Flop 極性:Inverting, Non-Inverting 輸入類型:CMOS 輸出類型: 傳播延遲時間:4.4 ns 高電平輸出電流:- 16 mA 低電平輸出電流:16 mA 電源電壓-最大:5.5 V 最大工作溫度:+ 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:X2SON-8 封裝:Reel |
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