參數(shù)資料
型號： 74HC4046
廠商： System Logic Semiconductor Co., Ltd.
英文描述： Phase-Locked Loop
中文描述： 鎖相環(huán)
文件頁數(shù)： 16/34頁
文件大小： 467K
代理商： 74HC4046
1997 Nov 25
16
Philips Semiconductors
Product specification
Phase-locked-loop with VCO
74HC/HCT4046A
DC CHARACTERISTICS FOR 74HCT
VCO section
Voltages are referenced to GND (ground = 0 V)
Note
1.
The parallel value of R1 and R2 should be more than 2.7 k
. Optimum performance is achieved when R1 and/or R2
are/is
>
10 k
.
SYMBOL
PARAMETER
T
amb
(
°
C)
UNIT
TEST CONDITIONS
74HCT
V
CC
(V)
V
I
OTHER
+25
40 to +85
40 to +125
min
typ.
max
min
max
min.
max.
V
IH
HIGH level
input voltage INH
2.0
1.6
2.0
2.0
V
4.5
to
5.5
4.5
to
5.5
4.5
V
IL
LOW level
input voltage INH
1.2
0.8
0.8
0.8
V
V
OH
HIGH level output
voltage VCO
OUT
4.4
4.5
4.4
4.4
V
V
IH
or
V
IL
V
IH
or
V
IL
V
IH
or
V
IL
V
IH
or
V
IL
V
IH
or
V
IL
V
CC
or
GND
I
O
= 20
μ
A
V
OH
HIGH level output
voltage VCO
OUT
3.98
4.32
3.84
3.7
V
4.5
I
O
= 4.0 mA
V
OL
LOW level output
voltage VCO
OUT
0
0.1
0.1
0.1
V
4.5
I
O
= 20
μ
A
V
OL
LOW level output
voltage VCO
OUT
0.15 0.26
0.33
0.4
V
4.5
I
O
= 4.0 mA
V
OL
LOW level output
voltage C1
A
, C1
B
(test purposes only)
input leakage
current
INH, VCO
IN
resistor range
resistor range
capacitor range
0.40
0.47
0.54
V
4.5
I
O
= 4.0 mA
±
I
I
0.1
1.0
1.0
μ
A
5.5
R1
R
2
C1
3.0
3.0
40
300
300
no
limit
3.4
k
k
pF
4.5
4.5
4.5
note 1
note 1
V
VCOIN
operating voltage
range at VCO
IN
1.1
V
4.5
over the
range
specified for
R1; for
linearity see
Figs 20
and 21
相關(guān)PDF資料
PDF描述
74HCT4052 Dual 4-channel analog multiplexer/demultiplexer(雙四通道模擬多路復(fù)用器/多路分解器)
74HCT4053 Triple 2-channel analog multiplexer/demultiplexer
74HC4053 Triple 2-channel analog multiplexer/demultiplexer
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74HC4094 8-stage shift-and-store bus register
相關(guān)代理商/技術(shù)參數(shù)
參數(shù)描述
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