參數(shù)資料
型號(hào)： 74HC4046
廠商： Fairchild Semiconductor Corporation
英文描述： CMOS Phase Lock Loop
中文描述： 的CMOS鎖相環(huán)
文件頁(yè)數(shù)： 4/34頁(yè)
文件大?。?/td> 467K
代理商： 74HC4046
1997 Nov 25
4
Philips Semiconductors
Product specification
Phase-locked-loop with VCO
74HC/HCT4046A
QUICK REFERENCE DATA
GND = 0 V; T
amb
= 25
°
C
Notes
1.
C
PD
is used to determine the dynamic power dissipation (P
D
in
μ
W):
P
D
= C
PD
×
V
CC2
×
f
i
+
∑
(C
L
×
V
CC2
×
f
o
) where:
f
i
= input frequency in MHz.
f
o
= output frequency in MHz.
C
L
= output load capacitance in pF.
V
CC
= supply voltage in V.
∑
(C
L
×
V
CC2
×
f
o
) = sum of outputs.
Applies to the phase comparator section only (VCO disabled). For power dissipation of the VCO and demodulator
sections see Figs 22, 23 and 24.
2.
ORDERING INFORMATION
See
“74HC/HCT/HCU/HCMOS Logic Package Information”
.
APPLICATIONS
FM modulation and demodulation
Frequency synthesis and multiplication
Frequency discrimination
Tone decoding
Data synchronization and conditioning
Voltage-to-frequency conversion
Motor-speed control.
PACKAGE OUTLINES
See
“74HC/HCT/HCU/HCMOS Logic Package Outlines”
.
SYMBOL
PARAMETER
CONDITIONS
TYPICAL
UNIT
HC
HCT
f
o
C
I
C
PD
VCO centre frequency
input capacitance (pin 5)
power dissipation capacitance per
package
C1 = 40 pF; R1 = 3 k
; V
CC
= 5 V 19
19
3.5
24
MHz
pF
pF
3.5
24
notes 1 and 2
相關(guān)PDF資料
PDF描述
74HC4046 Phase-Locked Loop
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相關(guān)代理商/技術(shù)參數(shù)
參數(shù)描述
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