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參數(shù)資料
| 型號(hào)： | 74F256 |
| 廠商： | NXP Semiconductors N.V. |
| 英文描述： | Dual addressable latch |
| 中文描述： | 雙尋址閉鎖 |
| 文件頁(yè)數(shù)： | 3/12頁(yè) |
| 文件大?。?/td> | 104K |
| 代理商： | 74F256 |
Philips Semiconductors
Product specification
74F256
Dual addressable latch
1988 Nov 29
3
LOGIC SYMBOL
V
= Pin 16
GND = Pin 8
E
A0
A1
MR
14
1
2
15
SF00806
Q0a Q1a Q2a Q3a
Q0b Q1b Q2b Q3b
4
5
6
7
9
10
11
12
3
13
Da
Db
IEC/IEEE SYMBOL
Z5
3
13
15
5, 7D
1
G4
C7
4R
SF00807
Z6
1
2
14
6, 8D
1
0
1
2
3
C8
4R
0
1
2
3
0
G0
3
1
4
5
6
7
9
10
11
12
FUNCTION TABLE
INPUTS
OUTPUTS
OPERATING MODE
MR
E
D
A0
A1
Q0
Q1
Q2
Q3
L
H
X
X
X
L
L
L
L
Master Reset
L
L
d
L
L
Q=d
L
L
L
Demultiplex (active-High decoder when D=H)
L
L
d
H
L
L
Q=d
L
L
L
L
d
L
H
L
L
Q=d
L
L
L
d
H
H
L
L
L
Q=d
H
H
X
X
X
q0
q1
q2
q3
Store (do nothing)
H
L
d
L
L
Q=d
q1
q2
q3
H
L
d
H
L
q0
Q=d
q2
q3
Addressable Latch
H
L
d
L
H
q0
q1
Q=d
q3
H
L
d
H
H
q0
q1
q2
Q=d
H =
L
X =
d
q
High voltage level
Low voltage level
Don’t care
High or Low data one setup time prior to the Low-to-High Enable transition
Lower case letters indicate the state of the referenced output established during the last cycle in which it was addressed or cleared.
=
=
=
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| 74F257ASCX | 2-Input Digital Multiplexer |
| 74F257ASJX | 2-Input Digital Multiplexer |
| 74F258ASCX | 2-Input Digital Multiplexer |
| 74F258ASJX | 2-Input Digital Multiplexer |
| 74F251ASCX | 8-Input Digital Multiplexer |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| 74F256PC | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Addressable D-Type Latch |
| 74F256QC | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Addressable D-Type Latch |
| 74F256SC | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Addressable D-Type Latch |
| 74F257 | 制造商:n/a 功能描述:74F257 S11L1C |
| 74F257A | 制造商:Motorola 功能描述:74F257 MOTOROLA S1I2B |
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