參數(shù)資料
型號(hào)： 74ABT374A
廠商： NXP Semiconductors N.V.
英文描述： Octal D-type flip-flop; positive-edge trigger 3-State
中文描述： 八路D型觸發(fā)器;積極邊緣觸發(fā)三態(tài)
文件頁數(shù)： 5/6頁
文件大?。?/td> 67K
代理商： 74ABT374A
Philips Semiconductors
Product specification
74ABT374A
Octal D-type flip-flop; positive-edge trigger
(3-State)
1995 Sep 06
5
AC SETUP REQUIREMENTS
GND = 0V, t
R
= t
F
= 2.5ns, C
L
= 50pF, R
L
= 500
LIMITS
SYMBOL
PARAMETER
WAVEFORM
T
amb
= +25
o
C
V
CC
= +5.0V
Min
T
amb
= -40 to +85
o
C
V
CC
= +5.0V
±
0.5V
Min
UNIT
Typ
t
s
(H)
t
s
(L)
t
h
(H)
t
h
(L)
t
w
(H)
t
w
(L)
Setup time, High or Low
Dn to CP
2
1.5
1.2
0.6
0.3
1.5
1.2
ns
Hold time, High or Low
Dn to CP
2
1.0
1.0
–0.3
–0.5
1.0
1.0
ns
CP pulse width
High or Low
1
2.0
2.8
0.8
1.0
2.0
2.8
ns
AC WAVEFORMS
V
M
= 1.5V, V
IN
= GND to 3.0V
VM
VM
VM
VM
VM
1/f
MAX
t
w
(H)
t
PHL
t
w
(L)
t
PLH
CP
Qn
SA00056
Waveform 1. Propagation Delay, Clock Input to Output, Clock
Pulse Width, and Maximum Clock Frequency
ééé
ééé
ééé
ééééééééé
ééééééééé
ééééééééé
V
M
Dn
V
M
V
M
M
M
M
CP
t
s
(H)
t
h
(H)
t
s
(L)
t
h
(L)
NOTE:
The shaded areas indicate when the input is permitted
to change for predictable output performance.
SA00107
Waveform 2. Data Setup and Hold Times
OE
V
M
t
PZH
t
PHZ
0V
Qn
V
M
V
M
SA00066
V
OH
–0.3V
Waveform 3. 3-State Output Enable Time to High Level and
Output Disable Time from High Level
OE
t
PZL
t
PLZ
0V
Qn
V
M
V
M
V
M
SA00067
V
OL
+0.3V
Waveform 4. 3-State Output Enable Time to Low Level and
Output Disable Time from Low Level
相關(guān)PDF資料
PDF描述
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74ABT374 Octal D-Type Flip-Flop with 3-STATE Outputs
74ABT374CMSAX Octal D-Type Flip-Flop
74ABT374CMTCX Octal D-Type Flip-Flop
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參數(shù)描述
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