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參數資料
| 型號： | 68HC908MR32VB |
| 廠商： | MOTOROLA INC |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | HCMOS Microcontroller Unit |
| 中文描述： | 8-BIT, FLASH, 8.2 MHz, MICROCONTROLLER, PDIP56 |
| 封裝： | SDIP-56 |
| 文件頁數： | 114/391頁 |
| 文件大?。?/td> | 2105K |
| 代理商： | 68HC908MR32VB |
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Advance Information
MC68HC908MR16/MC68HC908MR32
—
Rev. 5.0
114
Clock Generator Module (CGM)
MOTOROLA
Clock Generator Module (CGM)
The operating range of the VCO is programmable for a wide range of
frequencies and for maximum immunity to external noise, including
supply and CGMXFC noise. The VCO frequency is bound to a range
from roughly one-half to twice the center-of-range frequency, f
VRS
.
Modulating the voltage on the CGMXFC pin changes the frequency
within this range. By design, f
VRS
is equal to the nominal center-of-range
frequency, f
NOM
, (4.9152 MHz) times a linear factor, L or (L) f
NOM
.
CGMRCLK is the PLL reference clock, a buffered version of CGMXCLK.
CGMRCLK runs at a frequency, f
RCLK
, and is fed to the PLL through a
buffer. The buffer output is the final reference clock, CGMRDV, running
at a frequency, f
RDV
= f
RCLK
.
The VCO
’
s output clock, CGMVCLK, running at a frequency, f
VCLK
, is
fed back through a programmable modulo divider. The modulo divider
reduces the VCO clock by a factor, N. The divider
’
s output is the VCO
feedback clock, CGMVDV, running at a frequency, f
VDV
= f
VCLK/N
. (See
8.4.2.4 Programming the PLL
for more information.)
The phase detector then compares the VCO feedback clock, CGMVDV,
with the final reference clock, CGMRDV. A correction pulse is generated
based on the phase difference between the two signals. The loop filter
then slightly alters the dc voltage on the external capacitor connected to
CGMXFC based on the width and direction of the correction pulse. The
filter can make fast or slow corrections depending on its mode,
described in
8.4.2.2 Acquisition and Tracking Modes
. The value of the
external capacitor and the reference frequency determines the speed of
the corrections and the stability of the PLL.
The lock detector compares the frequencies of the VCO feedback clock,
CGMVDV, and the final reference clock, CGMRDV. Therefore, the
speed of the lock detector is directly proportional to the final reference
frequency, f
RDV
. The circuit determines the mode of the PLL and the lock
condition based on this comparison.
相關PDF資料 |
PDF描述 |
|---|---|
| 68HC908MR32VFU | HCMOS Microcontroller Unit |
| 68HC908MR32CB | HCMOS Microcontroller Unit |
| 68HC912DG128CPV8 | 1.2 MHz STEP-UP CONVERTER TAPE & REEL |
| 68HC912DG128MPV8 | HIGH VOLTAGE STEP DOWN REGULATOR |
| 696-2 | RECTIFIERS ASSEMBLIES |
相關代理商/技術參數 |
參數描述 |
|---|---|
| 68HC908MR32VFU | 制造商:MOTOROLA 制造商全稱:Motorola, Inc 功能描述:HCMOS Microcontroller Unit |
| 68HC908MR8FS | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:8-bit Microcontroller |
| 68HC908PT48 | 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:Advance Information |
| 68HC908QT1FS | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:8-Bit Microcontroller |
| 68HC908QT2FS | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:8-Bit Microcontroller |
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