參數(shù)資料
型號： 5962H9654002QXA
元件分類： 鎖存器
英文描述： AC SERIES, DUAL POSITIVE EDGE TRIGGERED J-KBAR FLIP-FLOP, COMPLEMENTARY OUTPUT, CDFP16
封裝： CERAMIC, DFP-16
文件頁數(shù)： 6/10頁
文件大?。?/td> 140K
代理商： 5962H9654002QXA
5
AC ELECTRICAL CHARACTERISTICS FOR THE UT54ACS109E2
(VDD = 3.0V to 5.5V; VSS = 0V
1, -55
°C < T
C < +125°C)
SYMBOL
PARAMETER
VDD
MINIMUM
MAXIMUM
UNIT
tPLH1
CLK to Q, Q
CL = 30pF
3.0V & 3.6V
4
23
ns
4.5V & 5.5V
4
19
CL = 50pF
3.0V & 3.6V
4
27
ns
4.5V & 5.5V
4
23
tPHL1
CLK to Q, Q
CL = 30pF
3.0V & 3.6V
5
27
ns
4.5V & 5.5V
5
23
CL = 50pF
3.0V & 3.6V
5
31
ns
4.5V & 5.5V
5
27
tPLH2
PRE to Q
CL = 30pF
3.0V & 3.6V
1
16
ns
4.5V & 5.5V
1
12
CL = 50pF
3.0V & 3.6V
1
20
ns
4.5V & 5.5V
1
16
tPHL2
PRE to Q
CL = 30pF
3.0V & 3.6V
1
19
ns
4.5V & 5.5V
1
15
CL = 50pF
3.0V & 3.6V
1
23
ns
4.5V & 5.5V
1
19
tPLH3
CLR to Q
CL = 30pF
3.0V & 3.6V
2
16
ns
4.5V & 5.5V
2
12
CL = 50pF
3.0V & 3.6V
2
20
ns
4.5V & 5.5V
2
16
tPHL3
CLR to Q
CL = 30pF
3.0V & 3.6V
2
19
ns
4.5V & 5.5V
2
15
CL = 50pF
3.0V & 3.6V
2
23
ns
4.5V & 5.5V
2
19
fMAX
Maximum clock frequency
CL = 50pF
3.0V, 4.5V, and
5.5V
62
MHz
tSU1
PRE or CLR inactive setup time
before CLK
↑
CL = 50pF
3.0V, 4.5V, and
5.5V
5
ns
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PDF描述
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