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參數(shù)資料
| 型號： | 28225-14 |
| 廠商： | MINDSPEED TECHNOLOGIES INC |
| 元件分類： | 數(shù)字傳輸電路 |
| 英文描述： | ATM/SONET/SDH SUPPORT CIRCUIT, PBGA256 |
| 封裝： | BGA-256 |
| 文件頁數(shù)： | 234/269頁 |
| 文件大?。?/td> | 3376K |
| 代理商： | 28225-14 |
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28229-DSH-001-B
Mindspeed Technologies
3
-1
3
IMA Clocks
In order to maintain transmit frame synchronization the IMA engine must know the
exact cell rate of each group. This is provided by the Transmit IMA Data Cell Rate
clock (Tx IDCR). In addition, to operate the Receive Cell Smoothing buffer the device
must know the Receive IMA Data Cell Rate (Rx IDCR). There is a Tx IDCR and Rx
IDCR for each of the 16 groups that the CX29229 supports.
The CX29229 provides for tremendous flexibility with regard to these clocks. An
oveview of the clocking circuitry is shown in Figure 3-1. While this can appear to be
overwhelming at first glance, most applications are actually quite straightforward. The
situation is also simplified by the software driver; it will calculate and program most
of the control registers automatically. The hardware designer only needs to ensure that
the proper clocks are available for the architecture desired.
In addition, two clock outputs are also provided: Tx_TRL[1] and Tx_TRL[0]. These
can be used to output one of the reference clock inputs or generate an 8 kHz reference
that is phase locked to IMA_SysClk or IMA_RefClk (whichever is used as a timing
reference).
The IDCR Clocks can be derived from one of four input sources:
1.
IMA_SysClk: This is the primary IMA system clock and is used by most of the
internal IMA logic. It is also used to generate the PHY side UTOPIA Rx and Tx
clocks (phyURxClk and phyUTxClk).
2.
IMA_RefClk: This is used with applications where multiple Transmit references
are available and/or when it is possible or necessary to run asynchronously
relative to IMA_SysClk. This signal is either a line or payload rate reference
clock or is a high speed (n x 8 kHz) reference clock from which nominal Transmit
and Receive payload rates can be derived.
3.
Receive bit clock: When operating in the UTOPIA-to-Serial mode the CX2822x
can select any of the Rx bit clocks to use as the reference clock. The receive
direction timing is used for recovering the IMA frame rate of the received IMA
group. Using this option for the Transmit IMA group frame rate results in a 'line
timed' configuration.
4.
phyURxClAv: This is the PHY side UTOPIA Rx Cell Available signal, which
tracks the actual cell data rate being transferred from an individual port. Internal
synthesizers can use this signal in place of the serial Rx bit clocks to derive the
payload rate for each Receive port. The receive direction timing is used for
recovering the IMA frame rate of the received IMA group. Using this option for
the Transmit IMA group frame rate results in a 'line timed' configuration.
相關PDF資料 |
PDF描述 |
|---|---|
| 28229-14 | ATM/SONET/SDH SUPPORT CIRCUIT, PBGA256 |
| 28230-13 | ATM SEGMENTATION AND REASSEMBLY DEVICE, PQFP208 |
| 28L0138-40R | 1 FUNCTIONS, FERRITE BEAD |
| 28L0138-70R | 1 FUNCTIONS, FERRITE BEAD |
| 28Z551 | TELECOM FILTER |
相關代理商/技術參數(shù) |
參數(shù)描述 |
|---|---|
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| 282257-000 | 功能描述:CABLE 1 COND 16AWG SHIELDED RoHS:是 類別:線纜，導線 >> 單芯導線 系列:- 產(chǎn)品培訓模塊:Basics of Wire and Cable 產(chǎn)品目錄繪圖:Stranded Hook Up Wire 標準包裝:1 系列:3070 纜線類型:電子線 線規(guī):24 AWG 線束:7/32 長度:100' (30.5m) 套管類型:聚氯乙烯（PVC） 套管直徑:0.088"（2.24mm） 套管（絕緣體）厚度:0.032"（0.81mm） 電壓:600V 工作溫度:-20°C ~ 105°C 顏色:藍 特點:UL 1015 型 線芯:1 其它名稱:3070 BK005 BLUEA3070L-100 |
| 282258-000 | 功能描述:CABLE 1 COND 18AWG SHIELDED RoHS:是 類別:線纜，導線 >> 單芯導線 系列:- 產(chǎn)品培訓模塊:Basics of Wire and Cable 產(chǎn)品目錄繪圖:Stranded Hook Up Wire 標準包裝:1 系列:3070 纜線類型:電子線 線規(guī):24 AWG 線束:7/32 長度:100' (30.5m) 套管類型:聚氯乙烯（PVC） 套管直徑:0.088"（2.24mm） 套管（絕緣體）厚度:0.032"（0.81mm） 電壓:600V 工作溫度:-20°C ~ 105°C 顏色:藍 特點:UL 1015 型 線芯:1 其它名稱:3070 BK005 BLUEA3070L-100 |
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