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參數(shù)資料
| 型號： | 20695 |
| 英文描述： | AMD-K6 Processor Multimedia Technology AMD-K6 Processor Data Sheet |
| 中文描述： | 的AMD - K6處理器多媒體技術(shù)的AMD - K6處理器數(shù)據(jù)手冊 |
| 文件頁數(shù)： | 117/346頁 |
| 文件大?。?/td> | 4918K |
| 代理商： | 20695 |
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Chapter 5
Signal Descriptions
99
20695H/0—March 1998
AMD-K6
Processor Data Sheet
Preliminary Information
5.25
HLDA (Hold Acknowledge)
Output
Summary
When HOLD is sampled asserted, the processor completes the
current bus cycles, floats the processor bus, and asserts HLDA
in an acknowledgment that these events have been completed.
The processor does not assert HLDA until the completion of a
locked sequence of cycles. While HLDA is asserted, another bus
master can drive cycles on the bus, including inquire cycles to
the processor. The following signals are floated when HLDA is
asserted: A[31:3], ADS#, ADSC#, AP, BE[7:0]#, CACHE#,
D[63:0], D/C#, DP[7:0], LOCK#, M/IO#, PCD, PWT, SCYC, and
W/R#.
The processor ensures that HLDA does not glitch.
Driven
HLDA is always driven except in Tri-State Test mode. If a
processor cycle is in progress while HOLD is sampled asserted,
HLDA is asserted one clock edge after the last BRDY# of the
cycle is sampled asserted. If the bus is idle, HLDA is asserted
one clock edge after HOLD is sampled asserted. HLDA is
negated one clock edge after the clock edge on which HOLD is
sampled negated.
The assertion of HLDA is independent of the sampled state of
BOFF#.
The processor floats the bus every clock in which HLDA is
asserted.
5.26
HOLD (Bus Hold Request)
Input
Summary
The system logic can assert HOLD to gain control of the
processor’s bus. When HOLD is sampled asserted, the processor
completes the current bus cycles, floats the processor bus, and
asserts HLDA in an acknowledgment that these events have
been completed.
Sampled
The processor samples HOLD on every clock edge. If a
processor cycle is in progress while HOLD is sampled asserted,
HLDA is asserted one clock edge after the last BRDY# of the
cycle is sampled asserted. If the bus is idle, HLDA is asserted
one clock edge after HOLD is sampled asserted. HOLD is
recognized while INIT and RESET are sampled asserted.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| 206966-1 | CONNECTORS CIRCULAR |
| 20702 | MARKERS WHITE PM41 |
| 207052-1 | ENTRY SEAL J/CABLE 7.62-11.43MM |
| 207052-2 | ENTRY SEAL J/CABLE 11.43-15.24MM |
| 207052-3 | ENTRY SEAL J/CABLE 15.24-22.22MM |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| 206950 | 制造商:Mitutoyo Corporation 功能描述:ANVIL NO.6 (OLD NO.205691) |
| 20695-111 | 制造商:EMERSON CONNECTIVITY SOLUTIONS 功能描述:CONNECTOR |
| 206952-1 | 制造商:TE Connectivity 功能描述: |
| 2069552-1 | 制造商:TE Connectivity 功能描述:INDUSTRIAL MINI I/O HDR ASSY EMBOSS VER. - Tape and Reel |
| 2069552-2 | 功能描述:INDUSTRIAL MINI I/O HDR ASSY E T 制造商:te connectivity amp connectors 系列:- 包裝:帶卷（TR） 零件狀態(tài):有效 連接器樣式:接頭 連接器類型:工業(yè)級迷你型，I 型 針腳數(shù):8 安裝類型:表面貼裝，直角 端接:焊接 特性:板導(dǎo)軌 觸頭鍍層:金 觸頭鍍層厚度:19.7μin（0.50μm） 標準包裝:1,800 |
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