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參數(shù)資料
| 型號： | μPD78F0228 |
| 廠商： | NEC Corp. |
| 元件分類： | 8位微控制器 |
| 英文描述： | 8-bit Microcontroller with 2/4/8K Bytes In-System Programmable Flash |
| 中文描述： | 8位微控制器與2/4/8K字節(jié)在系統(tǒng)可編程閃存 |
| 文件頁數(shù)： | 18/239頁 |
| 文件大小： | 871K |
| 代理商： | ΜPD78F0228 |
第1頁第2頁第3頁第4頁第5頁第6頁第7頁第8頁第9頁第10頁第11頁第12頁第13頁第14頁第15頁第16頁第17頁當(dāng)前第18頁第19頁第20頁第21頁第22頁第23頁第24頁第25頁第26頁第27頁第28頁第29頁第30頁第31頁第32頁第33頁第34頁第35頁第36頁第37頁第38頁第39頁第40頁第41頁第42頁第43頁第44頁第45頁第46頁第47頁第48頁第49頁第50頁第51頁第52頁第53頁第54頁第55頁第56頁第57頁第58頁第59頁第60頁第61頁第62頁第63頁第64頁第65頁第66頁第67頁第68頁第69頁第70頁第71頁第72頁第73頁第74頁第75頁第76頁第77頁第78頁第79頁第80頁第81頁第82頁第83頁第84頁第85頁第86頁第87頁第88頁第89頁第90頁第91頁第92頁第93頁第94頁第95頁第96頁第97頁第98頁第99頁第100頁第101頁第102頁第103頁第104頁第105頁第106頁第107頁第108頁第109頁第110頁第111頁第112頁第113頁第114頁第115頁第116頁第117頁第118頁第119頁第120頁第121頁第122頁第123頁第124頁第125頁第126頁第127頁第128頁第129頁第130頁第131頁第132頁第133頁第134頁第135頁第136頁第137頁第138頁第139頁第140頁第141頁第142頁第143頁第144頁第145頁第146頁第147頁第148頁第149頁第150頁第151頁第152頁第153頁第154頁第155頁第156頁第157頁第158頁第159頁第160頁第161頁第162頁第163頁第164頁第165頁第166頁第167頁第168頁第169頁第170頁第171頁第172頁第173頁第174頁第175頁第176頁第177頁第178頁第179頁第180頁第181頁第182頁第183頁第184頁第185頁第186頁第187頁第188頁第189頁第190頁第191頁第192頁第193頁第194頁第195頁第196頁第197頁第198頁第199頁第200頁第201頁第202頁第203頁第204頁第205頁第206頁第207頁第208頁第209頁第210頁第211頁第212頁第213頁第214頁第215頁第216頁第217頁第218頁第219頁第220頁第221頁第222頁第223頁第224頁第225頁第226頁第227頁第228頁第229頁第230頁第231頁第232頁第233頁第234頁第235頁第236頁第237頁第238頁第239頁
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Basic Configuration of Interrupt Function ............................................................................................. 145
Interrupt Request Flag Register Format ............................................................................................... 148
Interrupt Mask Flag Register Format .................................................................................................... 149
Priority Specify Flag Register Format ................................................................................................... 150
External Interrupt Rising Edge Enable Register Format ...................................................................... 151
External Interrupt Falling Edge Enable Register Format ..................................................................... 151
Program Status Word Configuration ..................................................................................................... 152
Flowchart of Occurrence and Acknowledge Non-Maskable Interrupt ................................................. 154
Non-Maskable Interrupt Request Acknowledge Timing ....................................................................... 154
Non-Maskable Interrupt Request Acknowledge Operation .................................................................. 155
Interrupt Request Acknowledge Processing Algorithm ........................................................................ 157
Interrupt Request Acknowledge Timing (Maximum Time) ................................................................... 158
Interrupt Request Acknowledge Timing (Minimum Time) .................................................................... 158
Multiple Interrupt Examples ................................................................................................................... 160
Interrupt Request Reserve .................................................................................................................... 162
13-1
13-2
13-3
13-4
13-5
Oscillation Stabilization Time Select Register Format ......................................................................... 164
HALT Mode Clear upon Interrupt Request Generation........................................................................ 166
HALT Mode Release by RESET Input .................................................................................................. 167
STOP Mode Release by Interrupt Request Generation ....................................................................... 169
Release by STOP Mode RESET Input ................................................................................................. 170
14-1
14-2
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14-4
Block Diagram of Reset Function.......................................................................................................... 171
Timing of Reset Input by RESET Input ................................................................................................. 172
Timing of Reset due to Watchdog Timer Overflow............................................................................... 172
Timing of Reset in STOP Mode by RESET Input ................................................................................. 172
15-1
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15-5
Memory Size Select Register Format ................................................................................................... 172
Internal Expansion RAM Size Select Register Format ........................................................................ 177
Communication Mode Select Format .................................................................................................... 178
Connection of Flashpro II in 3-Wire Serial I/O Mode........................................................................... 180
Connection of Flashpro II in Pseudo 3-Wire Serial I/O Mode ............................................................. 180
B-1
B-2
B-3
B-4
Development Tools................................................................................................................................. 200
NQPACK100RB (Target-Connected Side) Package Drawings (Refernce) .......................................... 207
HQPACK100RB (Lid for Device Mounted) Package Drawings (Reference)........................................ 208
YQPACK100RB (Probe Side) Package Drawings (Reference)............................................................ 209
LIST OF FIGURES (3/3)
Figure No.
Title
Page
相關(guān)PDF資料 |
PDF描述 |
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參數(shù)描述 |
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